SHARC
®
Melody
®
过激
音频的 处理器
adsst-sharc-melody-过激
SUMMARY
高 效能 32-位 音频的 处理器
超级的 harvard architecture 计算机 (sharc)
4 独立 buses 为 双 数据, 操作指南, 和
nonintrusive, 零-overhead i/o fetch 在 一个 单独的 循环
代号 兼容 和 所有 其它 sharc 家族 dsps
单独的-操作指南-多样的-数据 (simd) computational
architecture—two 32-位 ieee floating-要点 computation
单位, 各自 和 一个 乘法器, alu, shifter, 和 寄存器 文件
串行 端口 提供 i
2
s 支持 通过 8 可编程序的 和
同时发生的 receive 或者 transmit 管脚, 这个 支持 向上 至
16 transmit 或者 16 receive 途径 的 音频的
整体的 peripherals—integrated i/o 处理器, 1 mbit
在-碎片 双-ported sram, sdram 控制, glueless
multiprocessing 特性, 和 i/o 端口 (串行, link, 外部
总线, spi®, 和 jtag)
sharc melody 过激 支持 32-位 fixed-要点, 32-位
floating-要点, 和 40-位floating-要点 formats
ALU
MULT
数据
寄存器
文件
(pey)
16
×
40-位
BARREL
SHIFTER
MULT
ALU
数据
寄存器
文件
(pex)
16
×
40-位
计时器
操作指南
CACHE
32
×
48-位
DAG1
8
×
4
×
32
程序
SEQUENCER
DAG2
8
×
4
×
32
32
pm 地址 总线
dm 地址 总线
32
总线
连接
(px)
pm 数据 总线
dm 数据 总线
64
64
核心 处理器
spi 端口 (1)
串行 端口 (4)
link 端口 (2)
DMA
控制
5
16
20
4
IOP
寄存器
(记忆 编排)
控制,
状态, 和
数据 缓存区
i/o 处理器
二 独立
双-ported blocks
地址 数据
数据
数据
地址
地址 数据 地址
处理器 端口
i/o 端口
块 0
块 1
双-ported sram
host 端口
地址 总线
MUX
MULTIPROCESSOR
接口
数据 总线
MUX
32
24
外部 端口
6
12
8
JTAG
测试 &放大; emulation
GPIO
FLAGS
SDRAM
控制
IOA
18
IOD
64
BARREL
SHIFTER
图示 1. 函数的 块 图解
信息 陈设 用 相似物 设备 是相信 至 是 精确 和 可依靠的.
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