rev. B
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adsp-21065l
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dsp 微型计算机
摘要
高 业绩 信号 计算机 用于 communica-
区域, 音频, 汽车, 仪器仪表 和
工业 应用程序
超级 harvard 体系结构 计算机 (sharc
®
)
四 独立 公共汽车 用于 双 数据, 说明书,
和 我/o fetch 开启 一个 单独 循环
32-有点 定点 算术; 32-有点 和 40-有点 floating-
点 算术
544 kbits 片上 sram 记忆 和 综合 我/o
外围设备
我
2
s 支持, 用于 八 同时 接收 和 trans-
麻省理工学院 频道
钥匙 特点
66 mips, 198 mflops 峰值, 132 mflops 持续
业绩
用户-可配置 544 kbits 片上 sram 记忆
两个 外部 港口, dma 频道 和 八 串行
港口, dma 频道
sdram 控制器 用于 无胶 接口 至 低 成本
外部 记忆 (@ 66 mhz)
64m 字词 外部 地址 范围
12 可编程 我/o 针脚 和 两个 计时器 与 事件
捕获 选项
代码兼容 与 adsp-2106x 家庭
208-铅 mqfp 或 196-球 迷你-bga 包装
3.3 电压 操作
灵活 数据 格式 和 40-有点 扩展 精度
32-有点 单精度 和 40-有点 扩展精度 ieee
浮点 数据 格式
32-有点 定点 数据 格式, 整数 和 小数,
与 双 80-有点 蓄能器
平行 计算
单循环 相乘 和 alu 运营 入点 平行 与
双 记忆 阅读/写入 和 说明书 fetch
相乘 与 添加 和 减法 用于 加速 fft 但是-
terfly 计算
1024-点 复杂 fft benchmark: 0.274 ms (18,221
循环次数)
sport 1
4
IOP
寄存器
(记忆 已映射)
控制,
状态, 计时器
&放大器;
数据 缓冲区
我/o 处理器
说明书
高速缓存
32
48 有点
数据
地址
两个 独立
双端口 块
处理器 港口 我/o 港口
块 0
块 1
JTAG
测试一下 &放大器;
仿真
7
主机 港口
地址 总线
mux
IOA
17
iod
48
多处理机
接口
双端口 sram
外部
港口
数据 总线
mux
32
24
24
下午 地址 总线
dm 地址 总线
下午 数据 总线
dm 数据 总线
总线
连接
(px)
数据
注册
文件
16
40 有点
枪管
换档器
alu乘数
32
48
40
核心 处理器
dma
控制器
程序
音序器
DAG2
8
4
24
SDRAM
接口
(我
2
s)
(2 rx, 2tx)
(2 rx, 2tx)
(我
2
s)
sport 0
DAG1
8
4
32
数据 数据
数据
地址
地址
地址
图 1. 功能 块 图表
sharc 是 一个 已注册 商标 的 模拟 设备, 公司
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