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管脚 描述
W (管脚 1) 这个 三-水平的 逻辑 输入 sets 这 宽度 的
这 notch Notch 宽度 是 f
c2
–f
c1
(看
图示
1
) 当 W 是 系 至 V
一个
(管脚 14) 地 (管脚
13) 或者 V
b
(管脚 8) 这 notch 宽度 是 055 f
0

026 f
0
 或者 0127 f
0
 respectively
R (管脚 2) 这个 三-水平的 逻辑 输入 sets 这 比率 的
这 时钟 频率 (f
CLK
) 至 这 中心 fre-
quency (f
0
) 当 R 是 系 至 V
一个
 GND 或者
V
b
 这 时钟-至-中心-频率 比率 是
33331 501 或者 1001 respectively
LD (管脚 3) 这个 三-水平的 逻辑 输入 sets 这 分隔
因素 的 这 时钟 频率 divider 当
LD 是 系 至 V
一个
 GND 或者 V
b
 这 分隔
因素 是 716 596 或者 2 respectively
XTAL2 (管脚 4) 这个 是 这 输出 的 这 内部的 结晶 os-
cillator 当 使用 这 内部的 oscillator
这 结晶 应当 是 系 在 XTAL2
和 XTAL1 (这 电容 是 internal
非 外部 电容 是 需要 为 这
振荡器 至 operate) 当 不 使用 这
内部的 振荡器 这个 管脚 应当 是 left
open
XTAL1 (管脚 5) 这个 是 这 结晶 振荡器 input 当 美国-
ing 这 内部的 oscillator 这 结晶 应当
是 系 在 XTAL1 和 XTAL2 XTAL1
能 也 是 使用 作 一个 输入 为 一个 外部
时钟 信号 swinging 从 V
一个
至 V
b
 这
频率 的 这 结晶 或者 这 外部
时钟 将 是 分隔 内部 用 这 时钟
分隔物 作 决定 用 这 程序编制
电压 在 管脚 3
CLK (管脚 6) 这个 是 这 过滤 时钟 pin 这 时钟 信号
appearing 在 这个 管脚 是 这 过滤 时钟
(f
CLK
) 当 使用 这 内部的 结晶 oscil-
lator 或者 一个 外部 时钟 信号 应用 至
管脚 5 当 管脚 7 是 系 至 V
一个
 这 CLK 管脚 是
这 输出 的 这 分隔物 和 能 是 使用 至
驱动 其它 LMF90s 和 它的 栏杆-至-栏杆 输出
swing 当 不 使用 这 内部的 结晶
振荡器 或者 一个 外部 时钟 在 管脚 5 这
CLK 管脚 能 是 使用 作 一个 CMOS 或者 TTL
时钟 输入 提供 那 管脚 7 是 系 至
地 或者 V
b
 为 最好的 performance 这 职责
循环 的 一个 时钟 信号 应用 至 这个 管脚
应当 是 near 50% 特别 在 高等级的
时钟 frequencies
XLS (管脚 7) 这个 是 一个 三-水平的 逻辑 pin 当 XLS 是
系 至 V
一个
 这 结晶 振荡器 和 fre-
quency 分隔物 是 使能 和 CLK (管脚 6)
是 一个 output 当 XLS 是 系 至 地 (管脚
13) 这 结晶 振荡器 和 频率 di-
vider 是 无能 和 管脚 6 是 一个 输入 为 一个
时钟 swinging 在 V
b
和 V
一个
 当
XLS 是 系 至 V
b
 这 结晶 振荡器 和
频率 分隔物 是 无能 和 管脚 6 是 一个
TTL 水平的 时钟 输入 为 一个 时钟 信号
swinging 在 地 和 V
一个
或者 在
V
b
和 GND
V
b
(管脚 8) 这个 是 这 负的 电源 供应 pin 它
应当 是 绕过 和 在 least 一个 01
m
F
capacitor 为 单独的-供应 operation
连接 这个 管脚 至 系统 ground
V
输出
(管脚 9) 这个 是 这 过滤 output
D (管脚 10) 这个 二-水平的 逻辑 输入 是 使用 至 设置 这
depth 的 这 notch (这 attenuation 在 f
0
)
当 D 是 系 至 地 或者 V
b
 这 典型
notch depth 是 48 dB 或者 39 dB 各自的-
ly Note however 那 这 notch depth 是
也 依赖 在 这 宽度 设置 (管脚
1) 看 这 电的 特性 为
测试 limits
V
IN2
(管脚 11) 这个 是 这 输入 至 这 区别 放大器
部分 的 这 notch filter
V
IN1
(管脚 12) 这个 是 这 输入 至 这 内部的 通带
filter 这个 管脚 是 正常情况下 连接 至 管脚
11 为 宽 带宽 applications 一个
反对-aliasing 过滤 能 是 inserted 在
管脚 11 和 管脚 12
地 (管脚 13) 这个 是 这 相似物 地面 涉及 为 这
LMF90 在 分割 供应 applications 地
应当 是 连接 至 这 系统
ground 当 运行 这 LMF90 从 一个
单独的 积极的 电源 供应 voltage 管脚
13 应当 是 连接 至 一个 ‘‘clean’’ 谈及-
ence 电压 midway 在 V
一个
和
V
b

V
一个
(管脚 14) 这个 是 这 积极的 电源 供应 pin 它
应当 是 绕过 和 在 least 一个 01
m
F
capacitor
10 定义 的 条款
一个
最大值

这 最大 数量 的 增益 变化 在里面 这 fil-
ter’s passband (看
图示 1
) 为 这 LMF90 一个
最大值
是
nominally equal 至 025 dB
一个
最小值

这 最小 attenuation 在里面 这 notch’s stopband
(看
图示 1
) 这个 参数 是 调整 用 程序编制
电压 应用 至 管脚 10 (d)
带宽 (bw) 或者 Passband Width
这 区别 在 fre-
quency 在 这 notch filter’s 二 截止 frequencies
截止 Frequency
为 一个 notch filter 一个 的 这 二 fre-
quencies f
C1
和 f
C2
那 定义 这 edges 的 这 通过-
band 在 这些 二 frequencies 这 过滤 有 一个 增益 equal 至
这 passband gain
f
CLK

这 频率 的 这 时钟 信号 那 呈现 在 这
CLK pin 这个 频率 确定 这 filter’s 中心 fre-
quency 取决于 在 这 程序编制 电压 在 管脚 2
(r) f
CLK
将 是 也 3333 50 或者 100 时间 这 中心
频率 的 这 notch
f
0
或者 f
Notch

这 中心 频率 的 这 notch filter 这个
频率 是 量过的 用 finding 这 二 发生率 为
这个 这 增益
b
3 dB 相关的 至 这 passband gain 和
calculating 它们的 geometrical mean
Passband
为 一个 notch filter 发生率 在之上 这 upper
截止 频率 (f
C2
在
图示 1
) 和 在下 这 更小的 截止
频率 (f
C1
在
图示 1
)
10

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管脚描述 W (管脚 1) 这个三-水平的逻辑输入 sets 这宽度的这 notch Notch 宽度是 f c2 –f c1 (看图示 1 ) 当 W 是系至 V 一个 (管脚 14) 地 (管脚 13) 或者 V b (管脚 8) 这 notch 宽度是 055 f 0  026 f 0  或者 0127 f 0  respectively R (管脚 2) 这个三-水平的逻辑输入 sets 这比率的这时钟频率 (f CLK ) 至这中心 fre- quency (f 0 ) 当 R 是系至 V 一个  GND 或者 V b  这时钟-至-中心-频率比率是 33331 501 或者 1001 respectively LD (管脚 3) 这个三-水平的逻辑输入 sets 这分隔因素的这时钟频率 divider 当 LD 是系至 V 一个  GND 或者 V b  这分隔因素是 716 596 或者 2 respectively XTAL2 (管脚 4) 这个是这输出的这内部的结晶 os- cillator 当使用这内部的 oscillator 这结晶应当是系在 XTAL2 和 XTAL1 (这电容是 internal 非外部电容是需要为这振荡器至 operate) 当不使用这内部的振荡器这个管脚应当是 left open XTAL1 (管脚 5) 这个是这结晶振荡器 input 当美国- ing 这内部的 oscillator 这结晶应当是系在 XTAL1 和 XTAL2 XTAL1 能也是使用作一个输入为一个外部时钟信号 swinging 从 V 一个至 V b  这频率的这结晶或者这外部时钟将是分隔内部用这时钟分隔物作决定用这程序编制电压在管脚 3 CLK (管脚 6) 这个是这过滤时钟 pin 这时钟信号 appearing 在这个管脚是这过滤时钟 (f CLK ) 当使用这内部的结晶 oscil- lator 或者一个外部时钟信号应用至管脚 5 当管脚 7 是系至 V 一个  这 CLK 管脚是这输出的这分隔物和能是使用至驱动其它 LMF90s 和它的栏杆-至-栏杆输出 swing 当不使用这内部的结晶振荡器或者一个外部时钟在管脚 5 这 CLK 管脚能是使用作一个 CMOS 或者 TTL 时钟输入提供那管脚 7 是系至地或者 V b  为最好的 performance 这职责循环的一个时钟信号应用至这个管脚应当是 near 50% 特别在高等级的时钟 frequencies XLS (管脚 7) 这个是一个三-水平的逻辑 pin 当 XLS 是系至 V 一个  这结晶振荡器和 fre- quency 分隔物是使能和 CLK (管脚 6) 是一个 output 当 XLS 是系至地 (管脚 13) 这结晶振荡器和频率 di- vider 是无能和管脚 6 是一个输入为一个时钟 swinging 在 V b 和 V 一个  当 XLS 是系至 V b  这结晶振荡器和频率分隔物是无能和管脚 6 是一个 TTL 水平的时钟输入为一个时钟信号 swinging 在地和 V 一个或者在 V b 和 GND V b (管脚 8) 这个是这负的电源供应 pin 它应当是绕过和在 least 一个 01 m F capacitor 为单独的-供应 operation 连接这个管脚至系统 ground V 输出 (管脚 9) 这个是这过滤 output D (管脚 10) 这个二-水平的逻辑输入是使用至设置这 depth 的这 notch (这 attenuation 在 f 0 ) 当 D 是系至地或者 V b  这典型 notch depth 是 48 dB 或者 39 dB 各自的- ly Note however 那这 notch depth 是也依赖在这宽度设置 (管脚 1) 看这电的特性为测试 limits V IN2 (管脚 11) 这个是这输入至这区别放大器部分的这 notch filter V IN1 (管脚 12) 这个是这输入至这内部的通带 filter 这个管脚是正常情况下连接至管脚 11 为宽带宽 applications 一个反对-aliasing 过滤能是 inserted 在管脚 11 和管脚 12 地 (管脚 13) 这个是这相似物地面涉及为这 LMF90 在分割供应 applications 地应当是连接至这系统 ground 当运行这 LMF90 从一个单独的积极的电源供应 voltage 管脚 13 应当是连接至一个 ‘‘clean’’ 谈及- ence 电压 midway 在 V 一个和 V b  V 一个 (管脚 14) 这个是这积极的电源供应 pin 它应当是绕过和在 least 一个 01 m F capacitor 10 定义的条款一个最大值  这最大数量的增益变化在里面这 fil- ter’s passband (看图示 1 ) 为这 LMF90 一个最大值是 nominally equal 至 025 dB 一个最小值  这最小 attenuation 在里面这 notch’s stopband (看图示 1 ) 这个参数是调整用程序编制电压应用至管脚 10 (d) 带宽 (bw) 或者 Passband Width 这区别在 fre- quency 在这 notch filter’s 二截止 frequencies 截止 Frequency 为一个 notch filter 一个的这二 fre- quencies f C1 和 f C2 那定义这 edges 的这通过- band 在这些二 frequencies 这过滤有一个增益 equal 至这 passband gain f CLK  这频率的这时钟信号那呈现在这 CLK pin 这个频率确定这 filter’s 中心 fre- quency 取决于在这程序编制电压在管脚 2 (r) f CLK 将是也 3333 50 或者 100 时间这中心频率的这 notch f 0 或者 f Notch  这中心频率的这 notch filter 这个频率是量过的用 finding 这二发生率为这个这增益 b 3 dB 相关的至这 passband gain 和 calculating 它们的 geometrical mean Passband 为一个 notch filter 发生率在之上这 upper 截止频率 (f C2 在图示 1 ) 和在下这更小的截止频率 (f C1 在图示 1 ) 10

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