SC16C550B_集成电路资料查询网

飞利浦 半导体
SC16C550B
5 v, 3.3 v 和 2.5 v uart 和 16-字节 fifos
产品 数据 rev. 02 — 14 12月 2004 17 的 47
9397 750 14446
© koninklijke 飞利浦 electronics n.v. 2004. 所有 权利 保留.
图 10. 内部的 循环-后面的 模式 图解.
TRANSMIT
先进先出
寄存器
TX
RECEIVE
变换
寄存器
RECEIVE
先进先出
寄存器
RX
interconnect 总线 线条
和
控制 信号
SC16C550B
TRANSMIT
变换
寄存器
MODEM
控制
逻辑
时钟 和
波特 比率
发生器
XTAL2XTAL1
数据 BU S
和
控制 逻辑
D0–D7
ior, ior
iow, iow
重置
A0–A2
cs0, cs1
寄存器
选择
逻辑
INT
TXRDY
RXRDY
中断
控制
逻辑
002aaa587
mcr[4] = 1
CTS
RTS
DTR
RI
OUT1
OUT2
DCD
DSR
CS2
作
RCLK BAUDOUT
DDIS

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飞利浦半导体 SC16C550B 5 v, 3.3 v 和 2.5 v uart 和 16-字节 fifos 产品数据 rev. 02 — 14 12月 2004 17 的 47 9397 750 14446 © koninklijke 飞利浦 electronics n.v. 2004. 所有权利保留. 图 10. 内部的循环-后面的模式图解. TRANSMIT 先进先出寄存器 TX RECEIVE 变换寄存器 RECEIVE 先进先出寄存器 RX interconnect 总线线条和控制信号 SC16C550B TRANSMIT 变换寄存器 MODEM 控制逻辑时钟和波特比率发生器 XTAL2XTAL1 数据 BU S 和控制逻辑 D0–D7 ior, ior iow, iow 重置 A0–A2 cs0, cs1 寄存器选择逻辑 INT TXRDY RXRDY 中断控制逻辑 002aaa587 mcr[4] = 1 CTS RTS DTR RI OUT1 OUT2 DCD DSR CS2 作 RCLK BAUDOUT DDIS

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