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17
©2001 硅 存储 技术, 公司 s71161-06-000 9/01 504
表格 8: P
在
D
ESCRIPTION
标识 管脚 名字 类型
1
接口
功能PP FWH
一个
10
-一个
0
地址 I X 输入 为 低-顺序 地址 在 读 和 写 行动.
地址 是 内部 latched 在 一个 写 循环. 为 这 pro-
gramming 接口, 这些 地址 是 latched 用 r/c# 和 share
这 一样 管脚 作 这 高-顺序 地址 输入.
DQ
7
-dq
0
数据 i/o X 至 输出 数据 在 读 循环 和 receive 输入 数据 在
写 循环. 数据 是 内部 latched 在 一个 写 循环. 这 输出-
puts 是 在 触发-状态 当 oe# 是 高.
OE# 输出 使能 I X 至 门 这 数据 输出 缓存区
WE# 写 使能 I X 至 控制 这 写 行动
IC 接口
配置 管脚
I X X 这个 管脚 确定 这个 接口 是 运算的. 当 使保持 高,
programmer 模式 是 使能 和 当 使保持 低, fwh 模式 是
使能. 这个 管脚 必须 是 建制 在 电源-向上 或者 在之前 返回 从
重置 和 不 改变 在 设备 运作. 这个 管脚 是 内部
牵引的- 向下 和 一个 电阻 在 20-100 k
Ω.
INIT# Initialize I X 这个 是 这 第二 重置 管脚 为 在-系统 使用. 这个 管脚 是 内部
联合的 和 这 rst# 管脚; 如果 这个 管脚 或者 rst# 管脚 是 驱动 低,
完全同样的 运作 是 exhibited.
id[3:0] identification 输入 I X 这些 四 管脚 是 part 的 这 mechanism 那 准许 多样的 部分
至 是 连结 至 这 一样 总线. 这 strapping 的 这些 管脚 是 使用
至 identify 这 组件.这 激励 设备 必须 有 id[3:0]=0000
和 它 是 推荐 那 所有 subsequent 设备 应当 使用
sequential 向上-计数 strapping. 这些 管脚 是 内部 牵引的-向下
和 一个 电阻 在 20-100 k
Ω.
fgpi[4:0] 一般 目的 输入 I X 这些 单独的 输入 能 是 使用 为 额外的 板 flexibility.
这 状态 的 这些 管脚 能 是 读 通过 gpi_reg 寄存器.
这些 输入 应当 是 在 它们的 desired 状态 在之前 这 开始 的 这
pci 时钟 循环 在 这个 这 读 是 attempted, 和 应当
仍然是 在 放置 直到 这 终止 的 这 读 循环. unused gpi 管脚
必须 不 是 floated.
TBL# 顶 块 锁 I X 当 低, 阻止 程序编制 至 这 激励 块 sectors 在 顶 的
记忆. 当 tbl# 是 高 它 使不能运转 硬件 写 保护 为
这 顶 块 sectors. 这个 管脚 不能 是 left unconnected.
fwh[3:0] fwh i/os i/o X i/o communications
CLK 时钟 I X 至 提供 一个 时钟 输入 至 这 控制 单位
FWH4 fwh 输入 I X 输入 communications
RST# 重置 I X X 至 重置 这 运作 的 这 设备
WP# 写 保护 I X 当 低, 阻止 程序编制 至 所有 但是 这 最高的 addressable
blocks. 当 wp# 是 高 它 使不能运转 硬件 写 保护 为
这些 blocks. 这个 管脚 不能 是 left unconnected.
r/c# 行/column 选择 I X 选择 为 这 程序编制 接口, 这个 管脚 确定 whether
这 地址 管脚 是 pointing 至 这 行 地址, 或者 至 这 column
地址.
RES 保留 X 这些 管脚 必须 是 left unconnected.
V
DD
电源 供应 I X X 至 提供 电源 供应 (3.0-3.6v)
V
SS
地面 I X X 电路 地面 (ov 涉及) 每 v
SS
管脚 必须 是 grounded.
NC 非 连接 I X X unconnected 管脚
t8.3 504
1. i = 输入, o = 输出
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