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资料编号:1056158
 
资料名称:ADC700
 
文件大小: 149094K
   
说明
 
介绍:
16-Bit Resolution With Microprocessor Interface A/D Converter
 
 


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本平台电子爱好着纯手工中文简译:截至2020/5/17日,支持英文词汇500个
5
®
ADC700
管脚 配置
描述
和 运行 特性
这 adc700 是 一个 16-位 决议 successive approxima-
tion 一个/d 转换器. 并行的 数字的 数据 作 好 作 串行 数据
是 有. 一些 特性 有 被 包含 在 这
adc700 制造 它 easier 至 接口 和 微处理器
和/或者 串行 数据 系统. 一些 相似物 输入 范围 是
有.
一些 的 这 关键 运行 特性 是 描述 here. 更多
detail 是 给 在 后来的 sections 的 这 数据 薄板. 谈及 至 这
块 图解 在之上.
重置
这 adc700 有 一个 重置 输入 那 必须 是 asserted 在之上
电源-向上 或者 之后 一个 电源 中断. 这个 initializes 这
sar, 这 输出 缓存区 寄存器 和 数据 准备好 标记. 自从
微处理器 系统 already 使用 一个 电源-在 重置 电路,
这 一样 系统 重置 信号 能 是 使用 至 initialize 这
adc700.
并行的 数据
这 并行的 数据 输出 是 有 通过 一个 8-位 端口
和 3-状态 输出 驱动器. 高 字节 和 低 字节 是
选择 用 hben (管脚 10).
一个 缓存区/获得 是 包含 在 这 successive approxi-
mation 寄存器 (sar) 和 这 3-状态 驱动器. 这个 特性
准许 更多 有伸缩性的 接口 定时 比 是 可能 从
大多数 successive approximation 转换器.
这 “old” 文字 能 是 读 在 这 next 转换. 一个
数据 准备好 标记 (管脚 12) 是 asserted 当 一个 “new” 文字 是
在 这 缓存区 寄存器. 这 数据 准备好 标记 变得 低 (“0”)
当 这 大多数 重大的 字节 (高 字节) 是 读. 如果 这
“old” 文字 是 不 读, 或者 如果 仅有的 这 least 重大的 字节
(低 字节) 是 读, 数据 准备好 是 不 重置. 这 next
转换 输出 将 overwrite 这 数据 获得 当 这
转换 是 完全. 这 数据 准备好 标记 仍然是 高.
谈及 至 定时 图解 在 这 规格 部分.
串行 数据
十六-位 串行 数据 输出 是 有 (管脚 11) along 和
一个 串行 输出 strobe (管脚 14). 这个 串行 数据 strobe 是 不
这 内部的 sar 时钟 但是 是 一个 特定的 strobe 为 串行 数据
consisting 的 16 负的-going edges (在 转换)
occurring 关于 200ns 之后 各自 串行 数据 位 是 有效的. 这个
特性 eases 这 接口 至 变换 寄存器 或者 通过 opto-
couplers 为 产品 需要 galvanic 分开.
状态
这 familiar 状态 (或者 busy) 标记, 呈现 在 successive
approximation 一个/d 转换器, 是 有 (管脚 13) 和
indicates 那 一个 转换 是 在 progress. 状态 是 有效的
110ns 之后 assertion 的 这 转变 command (wr 低).
状态 不能 是 使用 作 一个 样本-支撑 控制 因为 那里
是 不 足够的 时间 为 这 样本-支撑 至 settle 至 这
必需的 错误 带宽 在之前 这 adc700 制造 它的 第一
转换 decision.
碎片 选择
cs (管脚 9) 选择 这 adc700. 非 其它 功能 能 是
执行 除非 cs 是 asserted. wr (管脚 7) 是 这 开始-
的-转换 strobe. rd strobes 各自 输出 数据 字节,
选择 用 hben (管脚 10), 至 这 3-状态 驱动器.
LSB
1
2
3
4
5
6
7
8
9
10
11
12
13
14
28
27
26
25
24
23
22
21
20
19
18
17
16
15
16-bit
d/a
转换器
Successive
Approximation
寄存器
20v range
10v range
相似物 common
数字的 common
V
BTCEN
db15/db7
db14/db6
db13/db5
db12/db4
db11/db3
db10/db2
db9/db1
db8/db0
DD
比较器 in
双极 offset
增益 adjust
Reset
WR
RD
CS
HBEN
串行 data
数据 ready
Status
串行 数据 strobe
CC
+V
CC
–V
所有 内部的 控制 线条 不 显示. 谈及 至 计算数量 4 和 5 为 补偿 和 增益 调整 连接.
Data
获得
3-state
驱动器
MSB LSB
Voltage
涉及
时钟 和 时钟 逻辑
5k
5k
MSB
控制 逻辑
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