10 的 17 march 26, 2001
IDT77222
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1
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7U
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HHHH
HH
这 与非 chain 提供 一个 简单的 测试 至 核实 那 所有 bond 线 是 安装 correctly 和 那 所有 焊盘 是 correctly soldered 在 一个 pcb.
所有 信号 焊盘 是 linked 在 一个 与非 chain, 这个 是 使能 用 asserting 一个 高, 或者 “1”, 在 与非_en (pin 201). asserting 一个 “1”在 这 其它 输入
forces 与非_输出 (管脚 193) 至 “1”. 用 successively 设置 这 输入 至 “0”, 开始 在 clk_out (pin 198) 和 移动的 至 txparity (管脚 191),
与非_输出 将 toggle 和 各自 改变.
1. 应用 一个 "1" 至 与非_en.
2. 设置 所有 这 i/o's 在 这 chain 至 "0" 和 与非_输出 应当 是 一个 "1".这 连接 顺序 的 这 管脚 在 这 chain 是 显示 in 这 与非 tree
管脚 顺序 表格 located 在 这 下列的 页.
3. 设置 clk_输出 至 一个 "0" 和 这 与非_输出 应当 是 一个 "0".
4. leaving 管脚 198 在 一个 "1" 设置 rst
(管脚 203) 至"1"和 与非_输出应当 是 一个 "1".
5. repeat 为 所有 remaining i/o's 在 这 与非 chain.
Ioh 高-水平的 ttl 输出 电流:
sr_一个(18-0)
2.4v -4 — — 毫安
Iol 低-水平的 ttl 输出 电流:
RxEnb
, rxclk, txsoc, txdata (7-0), txenb, txparity,
txclk, 我们
, oe, cs, sr_d31-0
V
SS
+ 0.4v 6 — — 毫安
Ioh 高-水平的 ttl 输出 电流:
RxEnb
, rxclk, txsoc, txdata7-0,TxEnb, txparity,
txclk, sr_我们
, sr, oe, sr_cs, sr_i/o(31-0)
2.4v -2 — — 毫安
Iol 低-水平的 ttl 输出 电流:
utl_ad(7-0), utl_rd
, utl_wr, utl_ale,
utl_cs0/1
, eesclk, eecs, eedo, phy_rst
V
SS
+ 0.4v 3 — — 毫安
Ioh 高-水平的 ttl 输出 电流:
utl_ad(7-0), utl_rd
, utl_wr, utl_ale,
utl_cs0/1
, eesclk, eecs, eedo, phy_rst
2.4v -1 — — 毫安
Iil 输入 泄漏 电流 V
SS
≤
V
在
≤
Vdd -1 1 — uA
Ityp 动态 供应 电流 — — 300 250 毫安
输入 脉冲波 水平 0 至 3.0v
输入 上升/下降 时间 2ns
输入 定时 ref. 水平的 1.5v
输出 ref. 水平的 1.5v
交流 测试 加载 看 图示 在下
表格 1 交流 测试 情况
6\PERO 3DUDPHWHU &放大;rqglwlrq 0LQ 0D[ 7\SLFDO 8QLW
1.5v
50
Ω
i/o
Z
0
=50
Ω
1
2
3
4
20 30 50 100 200
∆
tCD
(典型, ns)
电容 (pf)
80
5
6
5349 drw 05
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