1-3
信号 groupings
FCC1
atm/utopia
MPHY
主控
mux poll
或者 从动装置
MPHY
主控
dir. poll
FCC1
Ethernet
MII
hdlc/
transp.
HDLC
串行 Nibble
GPIO
TXENB
COL PA31
TXCLAV TXCLAV0 CRS
RTS
PA30
txsoc (主控) tx_er PA29
RXENB tx_en PA28
RXSOC
(从动装置)
rx_dv PA27
RXCLAV RXCLAV0 rx_er
SDMA
PA26
TXD0 MSNUM0 PA25
TXD1 MSNUM1 PA24
TXD2 PA23
TXD3 PA22
TXD4 TXD3 TXD3 PA21
TXD5 TXD2 TXD2 PA20
TXD6 TXD1 TXD1 PA19
TXD7 TXD0 TXD TXD0 PA18
RXD7 RXD0 RXD RXD0 PA17
RXD6 RXD1 RXD1 PA16
RXD5 RXD2 RXD2 PA15
RXD4 RXD3 RXD3 PA14
RXD3 MSNUM2 PA13
RXD2
SI1
MSNUM3 PA12
RXD1
TDMA1
MSNUM4 PA11
RXD0
SMC2
串行 Nibble MSNUM5 PA10
SMTXD
L1TXD L1TXD0 PA9
FCC2
SMRXD
L1RXD L1RXD0 PA8
Ethernet
MII
hdlc/
transp.
HDLC SMSYN
L1TSYNC
SI2
PA7
串行 Nibble
SCC2
L1RSYNC
TDMB2
PA6
tx_er RXD L1TXD PB31
rx_dv TXD L1RXD PB30
tx_en L1RSYNC PB29
rx_er
RTS
RTS/tena L1TSYNC PB28
COL
TDMC2
L1TXD
PB27
CRS L1RXD PB26
TXD3 TXD3 L1TXD3 L1TSYNC PB25
TXD2 TXD2 L1RXD3 L1RSYNC PB24
TXD1 TXD1 L1RXD2
TDMD2
L1TXD
PB23
TXD0 TXD TXD0 L1RXD1 L1RXD PB22
RXD0 RXD RXD0 L1TXD2 L1TSYNC PB21
RXD1 RXD1 L1TXD1 L1RSYNC
I
2
C
PB20
RXD2 RXD2 SDA PB19
RXD3 RXD3 SCL
BRGs Clocks 计时器
PB18
ext. req.
BRG1O CLK1 TGATE1 PC31
EXT1 BRG2O CLK2 TOUT1 PC30
SCC1
CTS/clsn
BRG3O CLK3 TIN2 PC29
CTS
/clsn
siu 计时器 输入
BRG4O CLK4
tin1/
TOUT2
PC28
CLK5
BRG5O CLK5 TGATE2 PC27
TMCLK
BRG6O CLK6 TOUT3 PC26
DMA
DACK2
BRG7O CLK7 TIN4 PC25
ext. req.
DREQ2 BRG8O CLK8
tin3/
TOUT4
PC24
EXT2 DACK1 CLK9 PC23
SCC1
LIST1 DREQ1 CLK10 PC22
TXADDR0
CTS/clsn
SMTXD PC15
RXADDR0 CD/rena LIST2 PC14
TXADDR1 CTS/clsn LIST4 PC13
RXADDR1
FCC1
CD/rena LIST3 PC12
TXADDR2
txaddr2/
TXCLAV1
CTS LIST1 PC7
RXADDR2
rxaddr2/
RXCLAV1
CD LIST2 PC6
FCC2 SMC1
CTS
SMTXD LIST3 PC5
CD SMRXD LIST4 PC4
RXD DRACK1/done1 PD31
TXD DRACK2/done2 PD30
RXADDR3 RXCLAV2 RTS/tena
SPI
PD29
TXADDR4 TXCLAV3
SPISEL
BRG1O PD19
RXADDR4 RXCLAV3 SPICLK PD18
RXPRTY SPIMOSI BRG2O PD17
TXPRTY SPIMISO PD16
TXADDR3 TXCLAV2 SMSYN PD7
图示 1-2.
cpm 端口 a–d 管脚 多路复用 符合实际
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