MAX8707
amd hammer cpu
、
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管脚 名字 函数
1D2
低-电压 vid dac 代号 输入. 这 d0–d4 输入 做 不 有 内部的 pullups. 这些 1.0v 逻辑 输入
是 设计 至 接口 直接地 和 这 cpu. 在 正常的 模式 (表格 4, sus = 地), 这 输出 电压
是 设置 用 这 vid 代号 表明 用 这 逻辑-水平的 电压 在 d0–d4. 在 suspend 模式 (sus = 高), 这
输出 电压 轨道 这 电压 在 susv.
2 D3 低-电压 vid dac 代号 输入
3 D4 低-电压 vid dac 代号 输入 (msb)
4 n.c. 非 连接.
leave 打开. 管脚 内部 连接.
5 SKIP
脉冲波-skipping 指示信号 输入. 当 脉冲波 skipping, 这 控制 blanks 这 vrok upper 门槛.
3.3v 或者 v
CC
(高) = 1-阶段 脉冲波-skipping 运作 (阶段 2, 3, 和 4 disabled)
地 = multiphase 强迫-pwm 运作
这 控制 automatically enters 强迫-pwm 模式 在 startup, 关闭, 和 这 非-cpu vid
模式.
6
SHDN
关闭 控制 输入. 这个 输入 不能 承受 这 电池 电压. 连接 至 v
CC
为 正常的
运作. 连接 至 地面 至 放 这 ic 在 它的 50na (典型值) 关闭 状态. 在 这 startup 和
关闭 transitions, 这 输出 电压 是 ramped 在 1/4th 这 输出-电压 回转 比率 编写程序 用
R
时间
. 之后 完成 软-关闭, 这 驱动器 是 disabled—
DRSKP
和 pwm_ 是 牵引的 低.
Forcing
SHDN
至 11v~13v 使不能运转 两个都 超(电)压-保护 和 欠压-保护 电路, 和
clears 这 故障 获得. 做 不 连接
SHDN
至 >13v.
7 SUS
suspend 控制 输入. 当 这 控制 发现 一个 转变 在 sus, 这 控制 slews 这 输出
电压 至 这 新 电压 水平的 决定 用 susv (sus = 高) 或者 d0–d4 (sus = 低). 这 控制
blanks vrok 在 这 转变 和 另一 20µs 之后 这 新 目标 电压 是 reached. 当 sus 是
高, 这 补偿 (ofs) 是 automatically 无能.
8 SUSV
suspend-模式 电压 输入. 连接 至 这 输出 的 一个 resistive 电压-分隔物 从 ref 至 地 至
提供 一个 相似物 电压 在 0.4v 至 2v. 这 输出 电压 是 设置 用 这 电压 在 susv 当 sus
是 高.
9 ilim(ave)
平均 电流-限制 门槛 调整. 这 控制 使用 这 精确 crsp-至-crsn 电流-
sense 电压 至 限制 这 平均 电流 每 阶段. 当 这 平均 电流-限制 门槛 是
超过, 这 控制 内部 减少 这 顶峰 inductor 电流-限制 门槛 (ilim(pk))
在 2% 的
I
PKLIMIT
每 µs 直到 这 平均 电流 仍然是 在里面 这 编写程序 限制. 当 这 精确 电流
感觉到 是 无能 (crsp = v
CC
), 这 平均 电流-限制 电路 是 无能 和 i
lim(ave)
应当 是
连接 至 v
CC
.
这 平均 电流-限制 门槛 defaults 至 25mv 如果 ilim(ave)
是 连接 至 v
CC
. 在 可调整的 模式,
这 平均 电流-限制 门槛 电压 是 precisely 1/20th 这 电压 区别 在 ilim(ave)
和 这 涉及: (v
REF
- v
ilim(ave)
) / 20 为 一个 范围 的 1.0v (v
REF
- 1v) 至 1.8v (v
REF
- 0.2v). 这 逻辑
门槛 为 switchover 至 这 25mv default 值 是 大概 v
CC
- 1v.
10 OFS
可调整的 补偿 电压 输入. 为 0 < v
OFS
< 0.8v, 1/8th 这 电压 在 ofs 是 subtracted 从 这
输出. 为 1.2v < v
OFS
< 2.0v, 1/8th 这 区别 在 ref 和 ofs 是 增加 至 这 输出.
电压 在 这 范围 的 0.8v < v
OFS
< 1.2v 是 未阐明的. 这 控制 使不能运转 这 补偿 放大器
在 suspend 模式 (sus = 高).
vid dac
。
D0–D4
。
1.0v CPU
。
(
4
,
sus = 地
)
,
D0–D4 VID
。
(
sus =
)
,
SUSV
。
vid dac
vid dac
(
MSB
)
。
。 ,
VROK
。
3.3v V
CC
( )
=
(
2
、
3 4
)
地 = PWM
、
cpu vid
,
PWM
。
。 。
V
CC
。
IC 50nA
( )
。 ,
R
时间
1/4
。 ,
DRSKP
pwm_
。
SHDN
11V~13V
, ,
。
SHDN
13V
。
。
SUS
, 、
SUSV
(
sus =
)
D0–D4
(
sus =
)
。
20
µ
s VROK
。
SUS
,
(
OFS
)
。
。
REF 地
,
0.4v 2V
。
SUS SUSV
。
。
crsp-crsn
。
,
µ
s 2% i
PKLIMIT
(
ILIM
(
PK
))
,
。
(
crsp = v
CC
)
, ,
I
LIM(ave)
V
CC
。
ilim(ave) V
CC
,
25mV
。 ,
ILIM(ave) 1/20
:
(
V
REF
- v
ILIM
(
AVE
)
)
/20
,
1.0v
(
V
REF
- 1v
)
1.8v
(
V
REF
- 0.2v
)
。
25mV V
CC
- 1v
。
。
0 < v
OFS
< 0.8v
,
OFS 1/8
。
1.2v < v
OFS
< 2.0v
,
REF OFS 1/8
。
0.8v < v
OFS
< 1.2v
。
(
sus =
)
,
。