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资料编号:1127661
 
资料名称:CY28346ZI-2T
 
文件大小: 545K
   
说明
 
介绍:
Clock Synthesizer with Differential CPU Outputs
 
 


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本平台电子爱好着纯手工中文简译:截至2020/5/17日,支持英文词汇500个
初步的
cy28346-2
文档 #: 38-07509 rev. *b 页 13 的 20
缓存区 特性
电流 模式 cpu 时钟 缓存区 特性
这 电流 模式 输出 缓存区 detail 和 电流 涉及
电路 详细信息 是 包含 在 这 previous 表格 的 这个 数据
薄板. 这 下列的 参数 是 使用 至 具体说明 输出
缓存区 特性:
1. 输出 阻抗 的 这 电流 模式 缓存区 电路 – ro
(看
图示 14
).
2. 最小 和 最大 必需的 电压 运作 范围
的 这 电路 – vop (看
图示 14
).
3. 序列 阻抗 在 这 缓存区 电路 – ros (看
图示 14
).
4. 电流 精度 在 给 配置 在 名义上的 测试
加载 为 给 配置.
66B
PCI
PCIF
1.5-
3.5ns
图示 12. 缓存区 模式 – 33v66(0:1); 66buf(0:2) 阶段 relationship
PCI
PCIF
Tpci
3V66
图示 13. unbuffered 模式 –3v66(0:5) 至 pci (0:6) 和pcif(0:2) 阶段 relationship
1.2v0v
Iout
Iout
Ros
Ro
VDD3 (3.3v +/- 5%)
vout = 1.2v 最大值 Vout
斜度 ~ 1/r
0
图示 14.
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