SAA5284GP_集成电路资料查询网

1998 二月 05 14
飞利浦 半导体 目标 规格
多媒体 video 数据 acquisition 电路 SAA5284
handbook, 全部 pagewidth
MGK147
t
7
t
2
t
5
t
3
t
6
t
4
t
1
d7 至 d0
RD
(1)
DMACK
DMARQ
有效的 数据 有效的 数据
CS
(一样 信号
作 dmack)
图.5  intel 模式 接口 dma 循环 定时.
(1) 读 数据 pipelined, 所以 非 rd 低 至 数据 有效的 设置-向上 时间.
表格 5
intel-模式 接口 dma 循环 定时 (12 mhz 时钟)
便条
1. 这个 定时 将 是 向上 至 3 时钟 循环 为 这 第一 读 在 dma 转移.
标识 描述 最小值 最大值 单位
t
1
dmarq 至 dmack 0
−
ns
t
2
rd 低 至 dmarq 低 0 212 ns
t
3
循环 时间 252
−
ns
t
4
dmack 至 rd 起作用的
−
0ns
t
5
数据 设置-向上 时间 0 90
(1)
ns
t
6
数据 支撑 时间 83
−
ns
t
7
数据 支撑 从 dmack 高 0 83 ns

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1998 二月 05 14 飞利浦半导体目标规格多媒体 video 数据 acquisition 电路 SAA5284 handbook, 全部 pagewidth MGK147 t 7 t 2 t 5 t 3 t 6 t 4 t 1 d7 至 d0 RD (1) DMACK DMARQ 有效的数据有效的数据 CS (一样信号作 dmack) 图.5 intel 模式接口 dma 循环定时. (1) 读数据 pipelined, 所以非 rd 低至数据有效的设置-向上时间. 表格 5 intel-模式接口 dma 循环定时 (12 mhz 时钟) 便条 1. 这个定时将是向上至 3 时钟循环为这第一读在 dma 转移. 标识描述最小值最大值单位 t 1 dmarq 至 dmack 0 − ns t 2 rd 低至 dmarq 低 0 212 ns t 3 循环时间 252 − ns t 4 dmack 至 rd 起作用的 − 0ns t 5 数据设置-向上时间 0 90 (1) ns t 6 数据支撑时间 83 − ns t 7 数据支撑从 dmack 高 0 83 ns

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