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管脚 非. Mnemonic
输入/
输出 描述
36 r
SET2
I
这个 管脚 是 使用 至 控制 这 amplitudes 的这 dac 4, dac 5, 和 dac 6 输出. 一个 4.12 kΩ
电阻 必须 是 连接 从 r
SET2
至 agnd.
45, 35
comp1,
COMP2
O 补偿 管脚. 连接 一个 2.2 nf 电容 从 两个都 竞赛 管脚 至 v
AA
.
44, 43, 42
dac 1, dac 2,
dac 3
O dac 输出. 全部 和 低 驱动 有能力 dacs.
39, 38, 37
dac 4, dac 5,
dac 6
O dac 输出. 低 驱动 仅有的 有能力 dacs.
21 scl/mosi I multifunctional 管脚: i
2
c 时钟 输入/spi 数据 输入.
20 sda/sclk i/o multifunctional 管脚: i
2
c 数据 输入/输出. 也, spi 时钟 输入.
19
alsb/spi_ss
I multifunctional 管脚: 这个 信号 sets 向上 这 lsb
2
的 这 mpu i
2
c 地址. 也, spi 从动装置 选择.
46 v
REF
optional 外部 电压 涉及 输入 为 dacs 或者 电压 涉及 输出.
41 v
AA
P 相似物 电源 供应 (3.3 v).
10, 56 V
DD
P
数字的 电源 供应 (1.8 v). 为 双-供应 配置, v
DD
能 是 连接 至 其它 1.8 v
供应 通过 一个 ferrite bead 或者 合适的 过滤.
1 v
dd_io
P 输入/输出 数字的 电源 供应 (3.3 v).
34 pv
DD
P
pll 电源 供应 (1.8 v). 为 双-供应 配置, pv
DD
能 是 连接 至 其它 1.8 v
供应 通过 一个 ferrite bead 或者 合适的 过滤.
33 ext_lf1 I 外部 循环 过滤 为 在-碎片 pll 1.
31 ext_lf2 I 外部 循环 过滤 为 在-碎片 pll 2.
32 PGND G pll 地面 管脚.
40 AGND G 相似物 地面 管脚.
11, 57 DGND G 数字的 地面 管脚.
64 地_io G 输入/输出 供应 地面 管脚.
1
ed = 增强 定义 = 525p 和 625p.
2
lsb = least 重大的 bit. 在 这 adv7342, 设置这 lsb 至 0 sets 这 i
2
c 地址 至 0xd4. 设置 它 至 1 sets 这 i
2
c 地址 至 0xd6. 在 这adv7343, 设置 这
lsb 至 0 sets 这 i
2
c 地址 至 0x54. 设置 它 至 1 sets 这 i
2
c 地址 至 0x56.
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