ADP3189
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至 增加 这 电流 在 任何 给 阶段, enlarge r
SW
为 那
阶段 (制造 r
SW
= 0 为 这 hottest 阶段 和 做 不 改变
在 保持平衡). 增加 r
SW
至 仅有的 500 Ω 制造 一个
substantial 增加 在 阶段 电流. 增加 各自 r
SW
值
用 小 amounts 至 达到 balance, 开始 和 这 coolest
阶段 第一.
电压 控制 模式
一个 高 增益-带宽 电压 模式 错误 放大器 是 使用 为
这 电压-模式 控制 循环. 这 控制 输入 电压 至 这
积极的 输入 是 设置 通过 这 vid 逻辑 符合 至 这 电压
列表 在
Table4.
这个 电压 是 也 补偿 用 这 droop 电压 为 起作用的
安置 的 这 输出 电压 作 一个 函数 的 电流,
commonly 知道 作 起作用的 电压 安置. 这 输出
的 这 放大器 是 这 竞赛 管脚, 这个 sets 这 末端
电压 为 这 内部的 pwm ramps.
这 负的 输入 (fb) 是 系 至 这 输出 sense location 和
一个 电阻 r
B
和 是 使用 为 感觉到 和 controlling 这 输出
电压 在 这个 要点. 一个 电流 源 从 这 fb 管脚 流
通过 r
B
是 使用 为 设置 这 非-加载 补偿 电压 从
这 vid 电压. 这 非-加载 电压 是 负的 和 遵守 至
这 vid dac. 这 主要的 循环 补偿 是 组成公司的
在 这 反馈 网络 在 fb 和 竞赛.
延迟 计时器
这 延迟 时间 为 这 开始-向上 定时 sequence 是 设置 和
一个 电容 从 这 延迟 管脚 至 地面. 在 uvlo, 或者 当
en 是 逻辑 低, 这 延迟 管脚 是 使保持 在 地面. 之后 这
uvlo 和 en 信号 是 asserted, 这 第一 延迟 时间 (td1 在
图示 8) 是 initiated. 一个 15 µa 电流 flows 输出 的 这 延迟
管脚 至 承担 c
DLY
. 一个 比较器 monitors 这 延迟 电压
和 一个 门槛 的 1.7 v. 这 延迟 时间 是 因此 设置 用 这
15 µa charging 一个 电容 从 0 v 至 1.7 v. 这个 延迟 管脚
是 使用 为 多样的 延迟 timings (td1, td3, 和 td5) 在
这 开始-向上 sequence. 也, 延迟 是 使用 为 定时 这
电流 限制 获得 止, 作 explained 在 这
电流 限制, 短的
电路, 和 获得-止 保护
部分.
软 开始
这 软 开始 时间 为 这 输出 电压 是 设置 和 一个 电容
从 这 ss 管脚 至 地面. 之后 td1 和 这 阶段 发现
循环 有 被 完成, 这 ss 时间 (td2 在
图示 8) 开始.
这 ss 管脚 是 disconnected 从 地, 和 这 电容 是
charged 向上 至 这 1.1 v 激励 电压 用 这 ss 放大器, 这个
有 一个 限制 输出 电流 的 15 µa. 这 电压 在 这 fb 管脚
跟随 这 ramping 电压 在 这 ss 管脚, 限制的 这 inrush
电流 在 开始-向上. 这 软 开始 时间 取决于 在 这
值 的 这 激励 电压 和 c
SS
.
once 这 ss 电压 是 在里面 100 mv 的 这 激励 电压, 这
激励 电压 延迟 时间 (td3) 是 started. 这 终止 的 这 激励
电压 延迟 时间 信号 这 beginning 的 这 第二 软 开始
时间 (td4). 这 ss 电压 now 改变 从 这 激励 电压
至 这 编写程序 vid dac 电压 (也 高等级的 或者 更小的)
使用 这 ss 放大器 和 这 限制 输出 电流 的 15 µa.
这 电压 的 这 fb 管脚 跟随 这 ramping 电压 的 这 ss
管脚, 限制的 这 inrush 电流 在 这 转变 从 这
激励 电压 至 这 最终 dac 电压. 这 第二 软 开始
时间 取决于 在 这 激励 电压, 这 编写程序 vid dac
电压, 和 c
SS
.
如果 也 en 是 带去 低 或者 vcc drops 在下 uvlo, 延迟
和 ss 是 重置 至 地面 至 是 准备好 为 另一 软 开始
循环.
图示 9显示 典型 开始-向上 波形 为 这
adp3189.
05626-009
CH11.0v ch2 1.0v
CH3 1.0v ch4 10.0v
m2.00ms 一个 ch1 500v
1
3
2
4
T22.0%
图示 9. 典型 开始-向上 波形
频道 1: csref, 频道 2: 延迟,
频道 3: ss, 频道 4: 阶段 1 转变 node
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