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资料编号:124607
 
资料名称:ADS1224IPWR
 
文件大小: 265K
   
说明
 
介绍:
24-Bit Analog-to-Digital Converter with 4-Channel Differential Input Multiplexer
 
 


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
sbas286a −六月 2003 − 修订 march 2004
www.德州仪器.com
14
标识 描述 最小值 最大值 单位
t
2
DRDY/dout 低 至 第一 sclk rising 边缘 0 ns
t
3
sclk 积极的 或者 负的 脉冲波 宽度 100 ns
t
4
(1)
sclk rising 边缘 至 新 数据 位 有效的: propogation 延迟 50 ns
t
5
sclk rising 边缘 至 old 数据 位 有效的: 支撑 时间 0 ns
t
6
(1)
数据 updating; 非 readback 允许 48
µ
s
t
7
(1)
转换 时间 (1/数据 比率) 8.32 8.32 ms
(1)
值 给 为 f
CLK
= 2mhz. 为 不同的 f
CLK
发生率, 规模 均衡的 至 clk 时期.
drdy/dout 23 22 21
124
0
LSBMSB
数据
数据 准备好
SCLK
t
2
t
7
t
3
t
3
t
6
数据 准备好
t
4
t
5
图示 25. 数据 retrieval 定时
23
12425
22 21 0
数据
25th SCLK 强迫 drdy/dout
数据 准备好
数据 准备好
drdy/dout
SCLK
图示 26. 数据 retrieval 和 drdy/dout 强迫 高 afterwards
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