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PARAMETERMEASUREMENTINFORMATION
注释: 一个. C
L
包含 探查 和 jig 电容.
b. Waveform 1 是 为 一个 输出 和 内部的 情况 此类 那 这 输出 是 低, 除了 当 无能 用 这 输出 控制.
Waveform 2 是 为 一个 输出 和 内部的 情况 此类 那 这 输出 是 高, 除了 当 无能 用 这 输出 控制.
c. 所有 输入 脉冲 是 有提供的 用 发生器 having 这 下列的 特性: prr
≤
10 mhz, z
O
= 50
Ω
, t
r
/t
f
= 3 ns.
d. 这 输出 是 量过的 一个 在 一个 时间, 和 一个 转变 每 度量.
e. t
PLZ
和 t
PHZ
是 这 一样 作 t
dis
.
f. t
PZL
和 t
PZH
是 这 一样 作 t
en
.
g. 所有 参数 和 波形 是 不 适用 至 所有 设备.
5, 10, 15, 30 pf
V
CC
/2
V
CC
0.15 v
V
CC
= 1.2 v
±
0.1 v
V
CC
= 0.8 v
V
CC
= 1.5 v
±
0.1 v
V
CC
= 1.8 v
±
0.15 v
V
CC
= 2.5 v
±
0.2 v
V
CC
= 3.3 v
±
0.3 v
5, 10, 15, 30 pf
V
CC
/2
V
CC
0.1 v
5, 10, 15, 30 pf
V
CC
/2
V
CC
0.1 v
5, 10, 15, 30 pf
V
CC
/2
V
CC
0.1 v
C
L
V
M
V
I
V
∆
5, 10, 15, 30 pf
V
CC
/2
V
CC
0.15 v
5, 10, 15, 30 pf
V
CC
/2
V
CC
0.3 v
输出
Waveform 1
s1 在 2
×
V
CC
(看 便条 b)
输出
Waveform 2
s1 在 地
(看 便条 b)
V
OL
V
OH
t
PZL
t
PZH
t
PLZ
t
PHZ
V
CC
0 v
V
OL
+ v
∆
V
OH
− v
∆
≈
0 v
V
CC
VOLTage waVEFORMS
使能 和 使不能运转 时间
低- 和 高-水平的 enabling
输出
控制
V
CC
/2 V
CC
/2
V
CC
/2
V
CC
/2
t
PLZ
/t
PZL
t
PHZ
/t
PZH
2
×
V
CC
地
测试 S1
从 输出
下面 test
C
L
(看 便条 一个)
加载 电路
S1
地
5 k
Ω
5 k
Ω
2
×
V
CC
SN74AUP1G125
低-powersinglebusbuffergate
with3-stateoutput
SCES595E–JULY2004–REVISEDJULY2005
(enableanddisabletimes)
figure4.loadcircuitandvoltagewaveforms
9
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