MAX1146–MAX1149
multichannel, 真实-差别的,
串行, 14-位 adcs
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详细地 描述
这 max1146–max1149 adcs 使用 一个 successive-
approximation 转换 技巧 和 输入 t/h cir-
cuitry 至 转变 一个 相似物 信号 至 一个 14-位 数字的
输出. 一个 有伸缩性的 串行 接口 提供 容易 inter-
面向 至 微处理器 (µps). 图示 4 显示 这 typi-
cal 应用 电路 和 图示 5 显示 一个 函数的
图解 的 这 max1148/max1149.
真实-差别的 相似物 输入 和
追踪/支撑
这 max1146–max1149 相似物 输入 architecture con-
tains 一个 相似物 输入 多路调制器 (mux), 二 t/h
电容, t/h switches, 一个 比较器, 和 二
切换 电容 数字的-至-相似物 转换器 (dacs)
(图示 6).
在 单独的-结束 模式, 这 相似物 输入 mux connects
in+ 至 这 选择 输入 频道 和 在- 至 com. 在
差别的 模式, in+ 和 在- 是 连接 至 这
选择 相似物 输入 pairs 此类 作 ch0/ch1. 选择
这 相似物 输入 途径 符合 至 tables 1–5.
这 相似物 输入 多路调制器 switches 至 这 选择
频道 在 这 控制 字节’s fifth sclk 下落 边缘. 在
这个 时间, 这 t/h switches 是 在 这 追踪 位置 和
C
t/h+
和 c
t/h-
追踪 这 相似物 输入 信号. 在 这
控制 字节’s eighth sclk 下落 边缘, 这 mux opens
和 这 t/h switches move 至 这 支撑 位置, retain-
ing 这 承担 在 c
t/h+
和 c
t/h-
作 一个 样本 的 这
输入 信号. 看 计算数量 8–11 为 输入 mux 和 t/h
转变 安置.
在 这 转换 间隔, 这 切换 电容的
dac adjusts 至 restore 这 比较器-输入 电压 至
0 在里面 这 限制 的 14-位 决议. 这个 action
需要 15 转换 时钟 循环 和 是 相等的
至 transferring 一个 承担 的 18pf
×
(v
IN+
- v
在-
) 从
C
t/h+
和 c
t/h-
至 这 二进制的-weighted 电容的
dac, forming 一个 数字的 描述 的 这 相似物
输入 信号.
之后 转换, 这 t/h switches move 从 这 支撑
位置 至 这 追踪 位置 和 这 mux switches
后面的 至 这 last 指定 位置. 在 内部的 时钟
模式, 这 转换 是 完全 在 这 rising 边缘 的
sstrb. 在 外部 时钟 模式, 这 转换 是 com-
plete 在 这 eighteenth sclk 下落 边缘.
这 时间 必需的 为 这 t/h 至 acquire 一个 输入 信号
是 一个 函数 的 这 相似物 输入 源 阻抗. 如果
这 输入 信号 源 阻抗 是 高, 这 acquisi-
tion 时间 lengthens. 这 max1146–max1149 提供
三 sclk 循环 (t
ACQ
) 在 这个 这 t/h 电容
必须 acquire 一个 承担 representing 这 输入 信号,
典型地 这 last 三 sclks 的 这 控制 文字. 这
输入 源 阻抗 (r
源
) 应当 是 迷你-
mized 至 准许 这 t/h 电容 至 承担 在里面
这个 allotted 时间.
t
ACQ
= 11.5
×
(r
源
+ r
在
)
×
C
在
在哪里 r
源
是 这 相似物 输入 源 阻抗,
R
在
是 2.6k
Ω
(这个 是 这 总 的 这 相似物 输入 mux
和 t/h 转变 抵制), 和 c
在
是 18pf (这个 是
这 总 的 c
t/h+
, c
t/h-
, 和 输入 偏离 电容).
至 降低 抽样 errors 和 高等级的 源 imped-
ances, 连接 一个 100pf 电容 从 这 相似物
输入 至 agnd. 这个 输入 电容 减少 这 输入’s
交流 阻抗 但是 形式 一个 rc 过滤 和 这 源
阻抗,限制的 这 相似物 输入 带宽. 为
大 源 阻抗, 使用 一个 缓存区 放大器 此类 作
这 max4430 至 维持 相似物 输入 信号 integrity.
MAX1148
MAX1149
SCLK
DIN
DOUT
SSTRB
V
DD
V
DD
V
DD
V
SS
REFADJ
COM
相似物
输入
CH4
CH5
CH6
CH7
CH0
CH1
CH2
CH3
REF
AGND DGND
0.01
µ
F
0.1
µ
F 4.7
µ
F
2.2
µ
F
µ
P
i/o
i/o
i/o
SCK
MOSI
MISO
10
Ω
SHDN
CS
图示 4. 典型 应用 电路
MAX1149
相似物
输入
MUX
控制
逻辑
内部的
时钟
输入
变换
寄存器
输出
变换
寄存器
+1.250v
BANDGAP
涉及
t/h
DOUT
SSTRB
V
DD
AGND
SCLK
DIN
COM
REFADJ
REF
CH6
CH7
CH4
CH5
CH1
CH2
CH3
CH0
DGND
SAR
模数转换器
REF
时钟
在
输出
20k
Ω
一个
V
= 2.0v/v
CS
SHDN
图示 5. 函数的 图解
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