8705BY
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rev. g 六月 16, 2004
9
整体的
电路
系统, 公司
ICS8705
Z
ERO
D
ELAY
, d
IFFERENTIAL
-
至
-lvcmos/LVTTL
C
锁
G
ENERATOR
O
UTPUT
D
UTY
C
YCLE
/p
ULSE
W
IDTH
/p
ERIOD
P
ROPAGATION
D
ELAY
P
HASE
J
ITTER
&放大; s
TATIC
P
HASE
O
FFSET
q0:q7
t
PD
V
DDO
2
➤
➤
V
DD
2
CLK1
nCLK1
CLK0
t
PW
t
时期
V
DDO
2
V
DDO
2
V
DDO
2
t
PW
t
时期
odc =
q0:q7
(在哪里
t
(Ø) 是 任何 随机的 样本, 和
t
(Ø)
意思
是 这 平均
的 这 抽样 循环 量过的 在 控制 edges)
t
(Ø)
意思
= 静态的 阶段 补偿
➤
➤
t
(Ø)
V
OH
V
OL
V
OH
V
OL
V
DDO
2
nCLK1
fb_在
t
jit(Ø) =
t
(Ø) —
t
(Ø)
意思
= 阶段 jitter
CLK1