初步的 技术的 数据 AD7760
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ad7760 接口
读 数据
这 ad7760 使用 一个 16-位 bi-directional 并行的 接口. 这个
接口 是 控制 用 这
RD
/wr 和
CS
管脚. 那里 是
二 读 运行 模式 取决于 在 这 输出 数据 比率.
当 这 ad7760 是 outputting 数据 在 5msps 或者 较少, 这
接口 运作 在 一个 常规的 模式 作 显示 在 图示 2.
当 一个 新 转换 结果 是 有, 一个 起作用的 低 脉冲波 是
输出 在 这
DRDY
管脚. 至 读 一个 转换 结果 从 这
ad7760, 二 16-位 读 行动 是 执行. 这
DRDY
脉冲波 indicates 那 一个 新 转换 结果 是 有. 两个都
RD
/wr 和
CS
go 低 至 执行 这 第一 读 运作.
shortly 之后 两个都 这些 线条 go 低, 这 databus 变为 起作用的
和 这 16 大多数 重大的 位 (msbs) 的 这 转换 结果
是 输出. 这
RD
/wr 和
CS
线条 必须 返回 高 为 一个
时期 的 tbd ns 在之前 这 第二 读 是 执行. 这个
第二 读 将 包含 这 8 least 重大的 位 (lsbs) 的
这 转换 结果 along 和 7 状态 位. 这些 状态 位
是 显示 在 表格 6. 这 cal 位 是 设置 至 一个 1 如果 一个 校准 有
被 执行. 表格 14 包含 描述 的 这 其它
状态 位.
表格 6. 状态 位在 数据 读
D7 D0
dvalid ovr ufilt lpwr filtok dlokCal 0
shortly 之后
RD
/wr 和
CS
返回 高, 这 databus 将
返回 至 一个 高 阻抗 状态. 两个都 读 行动 必须 是
完成 在之前 一个 新 转换 结果 是 有 作 这 新
结果 将 overwrite 这 内容 在 这 输出 寄存器. 如果 一个
DRDY
脉冲波 occurs 在 一个 读 运作, 这 数据 读 将
是 invalid.
当 这 ad7760 是 运行 在 modulator 数据 输出 模式,
i.e. 输出 数据 比率 在 20mhz, 一个 不同的 接合 scheme
是 需要. 至 获得 数据 from 这 ad7760 在 th是 模式, 两个都
RD
/wr 和
CS
线条 必须 是 使保持 低. 这个 将 bring 这
databus 输出 的 它的 高 阻抗 状态. 图示 3 显示 这
20mhz 输出 数据 比率 运作. 一个
DRDY
脉冲波 是
发生 为 各自 文字 和 这 数据 是 有效的 在 这 rising 边缘
的 这
DRDY
脉冲波. 这个
DRDY
脉冲波 可以 是 使用 至 获得 这
modulator 数据 在 一个 先进先出 或者 作 一个 dma 控制 信号. shortly
之后 这
RD
/wr 和
CS
线条 返回 高, 这 ad7760 将
停止 outputting 数据 和 这 databus 将 返回 至 高
阻抗.
分享 这 并行的 总线
用 它的 nature, 这 高 精度 的 这 ad7760 制造 它 敏感的
至 外部 噪音 来源. 这些 包含 数字的 activity 在 这
并行的 总线. 为 这个 reason 它 是 推荐 那 这 ad7760
数据 线条 是 分开的 从 这 系统 databus 用 意思 的 一个
获得 或者 缓存区 至 确保 那 那里 是 非 数字的 activity 在 这
d0-d15 管脚 那 是 不 控制 用 这 ad7760. 如果 多样的,
同步, ad7760 部分 那 share 一个 合适的 distributed
一般 mclk 信号 exist 在 一个 系统, 这些 部分 能 share 一个
一般 总线 没有 正在 分开的 从 各自 其它. 这个 总线
能 然后 是 分开的 从 这 系统 总线 用 一个 单独的 获得 或者
缓存区.
writing 至 这 ad7760
之后 一个 重置, 仅有的 一个 单独的 写 运作 至 电源 向上 这
ad7760 是 需要 至 开始 这 部分 converting 在 default
settings. 当 这 ad7760 是 配置 至 转变 相似物
信号 和 这 default settings 在 重置, 那里 是 许多 特性
和 参数 在 这个 部分 那 这 用户 能 改变 用 writing
至 这 设备. 作 一些 的 这 可编程序的 寄存器 是 16 位
宽, 至 程序 一个 寄存器 需要 二 写 行动. 这
第一 写 包含 这 寄存器 地址 当 这 第二 写
包含 这 寄存器 数据. 那里 是 一个 例外 至 这个 当 一个
用户 过滤 是 正在 下载 至 这 ad7760. 这个 是 dealt
和 在 detail 在 这 下列的 部分. 这 ad7760 寄存器
部分 包含 这 寄存器 地址 和 更远 详细信息.
图示 4 显示 一个 写 运作 至 这 ad7760. 这
RD
/wr
线条 是 使保持 高 当 这
CS
线条 是 brought 低 为 一个 最小
的 tbd ns. 这 寄存器 地址 是 latched 在 这个 时期.
这
CS
线条 是 brought 高 又一次 为 一个 最小 的 tbd ns
在之前 这 寄存器 数据 是 放 面向 这 databus. 如果 一个 读
运作 occurs 在 这 writing 的 这 寄存器 地址
和 这 寄存器 数据, 这 寄存器 地址 是 cleared 和 这 next
写 必须 是 这 寄存器 地址 又一次. 这个 也 提供 一个
方法 至 得到 后面的 至 一个 知道 situation 如果 这 用户 somehow
loses 追踪 whether 这 next 写 是 一个 地址 或者 数据.
它 是 envisaged 那 这 ad7760 将 是 写 至 和
配置 在 电源-向上 和 非常 infrequently, 如果 在 所有, 之后
那. 下列的 任何 写 运作, 这 全部 组 延迟 的 这
过滤 必须 通过 在之前 有效的 数据 将 是 输出 从 这
ad7760.
读 状态 和 其它 寄存器
这 ad7760 特性 一个 号码 的 可编程序的 寄存器. 至
读 后面的 这 内容 的 这些 寄存器 或者 这 状态 寄存器,
这 用户 必须 第一 写 至 这 控制 寄存器 的 这 设备
设置 一个 位 相应的 至 这 寄存器 它们 wish 至 读. 这
next 读 运作 将 然后 输出 这 内容 的 这 选择
寄存器 instead 的一个 转换 结果. 更多 信息 在 这
相关的 位 在 这 控制 寄存器 是 给 在 这 ad7760
寄存器 部分.
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