AD9851BRS_集成电路资料查询网

AD9851
–17–rev. c
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11 1
STROBE
D0
D1
D2
D3
D4
D5
D6
D7
U2
74HCT574
J1
C36CPR2
RRSET
8D
7D
6D
5D
4D
3D
2D
1D
8Q
7Q
6Q
5Q
4Q
3Q
2Q
1Q
CK
OE
FFQUD
WWCLK
审查
STROBE
V
CC
Y1
输出
地
7
8
14
+5V
XTAL
OSC
(optional)
R2
50

J5
CLKIN
除去 当
使用 y1
H1
#6
H2
#6
H3
#6
H4
#6
挂载 孔
R3
2.2k

STROBE
+5V
WWCLKFFQUDRRESET
R11
2.2k

R9
2.2k

R10
2.2k

J2
+V
J3
+5V
J4
地
BANANA
JACKS
28
27
26
25
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23
22
21
20
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14
VOUTP
VOUTN
R
设置
AVDD
AGND
REFCLOCK
FQ
UD
D3
D2
D1
D0
W
CLK
PVCC
PGND
VINN
VINP
DACBL
AVDD
AGND
IOUTB
IOUT
D4
D5
D6
D7
重置
DVDD
DGND
U1
AD9851
+V
地
CLKIN
FQUD
D3
D2
D1
D0
WCLK
+V
地
+V
地
D4
D5
D6
D7
重置
+V
地
R5
100k

R12
J7
BNC
R1
3.9k

10mA
重置
C1
470pF
E1 E2
R4
100k

E6 E5
R6
200

C11
22pF
C12
1pF
L1
470nH
C13
33pF
C14
5.6pf
L2
390nH
C15
22pF
C16
4.7pf
L3
390nH
C17
22pF
R7
200

70mhz elliptical 低 通过 过滤
7th 顺序 200

Z
至 绕过 在 板 过滤
1. 除去 e6 至 e5 跳越者
2. 安装 适合的 r12 为 iout 末端
R8
100

J6
E4 E3
J8
BNC
J9
BNC
9
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7
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8D
7D
6D
5D
4D
3D
2D
1D
8Q
7Q
6Q
5Q
4Q
3Q
2Q
1Q
CK
OE
11 1
STROBE
重置
WCLK
FQUD
审查
U3
74HCT574
RRESET
WWCLK
FFQUD
RRESET
ad9851/cgpcb
时钟 发生器
evaluation 板
(ssop 包装)
C2
0.1

F
C3
0.1

F
C4
0.1

F
C5
0.1

F
C8
0.1

F
C9
0.1

F
C10
0.1

F
+V
+5V
C6
10

F
C7
10

F
+V
+5V
NC
nc = 非 连接
图示 24. cgpcb 电的 图式

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AD9851 –17–rev. c 1 2 3 4 5 6 7 8 9 10 11 12 13 14 15 16 17 18 19 20 21 22 23 24 25 26 27 28 29 30 31 32 33 34 35 36 9 8 7 6 5 4 3 2 12 13 14 15 16 17 18 19 11 1 STROBE D0 D1 D2 D3 D4 D5 D6 D7 U2 74HCT574 J1 C36CPR2 RRSET 8D 7D 6D 5D 4D 3D 2D 1D 8Q 7Q 6Q 5Q 4Q 3Q 2Q 1Q CK OE FFQUD WWCLK 审查 STROBE V CC Y1 输出地 7 8 14 +5V XTAL OSC (optional) R2 50  J5 CLKIN 除去当使用 y1 H1 #6 H2 #6 H3 #6 H4 #6 挂载孔 R3 2.2k  STROBE +5V WWCLKFFQUDRRESET R11 2.2k  R9 2.2k  R10 2.2k  J2 +V J3 +5V J4 地 BANANA JACKS 28 27 26 25 24 23 22 21 20 19 18 17 16 15 1 2 3 4 5 6 7 8 9 10 11 12 13 14 VOUTP VOUTN R 设置 AVDD AGND REFCLOCK FQ UD D3 D2 D1 D0 W CLK PVCC PGND VINN VINP DACBL AVDD AGND IOUTB IOUT D4 D5 D6 D7 重置 DVDD DGND U1 AD9851 +V 地 CLKIN FQUD D3 D2 D1 D0 WCLK +V 地 +V 地 D4 D5 D6 D7 重置 +V 地 R5 100k  R12 J7 BNC R1 3.9k  10mA 重置 C1 470pF E1 E2 R4 100k  E6 E5 R6 200  C11 22pF C12 1pF L1 470nH C13 33pF C14 5.6pf L2 390nH C15 22pF C16 4.7pf L3 390nH C17 22pF R7 200  70mhz elliptical 低通过过滤 7th 顺序 200  Z 至绕过在板过滤 1. 除去 e6 至 e5 跳越者 2. 安装适合的 r12 为 iout 末端 R8 100  J6 E4 E3 J8 BNC J9 BNC 9 8 7 6 5 4 3 2 12 13 14 15 16 17 18 19 8D 7D 6D 5D 4D 3D 2D 1D 8Q 7Q 6Q 5Q 4Q 3Q 2Q 1Q CK OE 11 1 STROBE 重置 WCLK FQUD 审查 U3 74HCT574 RRESET WWCLK FFQUD RRESET ad9851/cgpcb 时钟发生器 evaluation 板 (ssop 包装) C2 0.1  F C3 0.1  F C4 0.1  F C5 0.1  F C8 0.1  F C9 0.1  F C10 0.1  F +V +5V C6 10  F C7 10  F +V +5V NC nc = 非连接图示 24. cgpcb 电的图式

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