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资料编号:251851
 
资料名称:AD9851BRS
 
文件大小: 254.14K
   
说明
 
介绍:
CMOS 180 MHz DDS/DAC Synthesizer
 
 


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AD9851
–20– rev. c
0
–10
–20
–30
–40
–50
–60
–70
–80
–90
–100
2AP
1.1mhz
中心
200kHz
SPAN
20khz/
rbw = 300hz
vbw = 300hz
swt = 11.5s
rf att = 20db
ref lvl = –7dbm
图示 29. narrowband (1.1
±
0.1 mhz) 输出 sfdr 为 一个
1.1 mhz 基本的 输出 信号. 系统 时钟 =
180 mhz (6
×
refclk 乘法器 engaged), v
S
= +5 v.
0
–10
–20
–30
–40
–50
–60
–70
–80
–90
–100
2AP
40.1mhz
中心
200kHz
SPAN
20khz/
rbw = 300hz
vbw = 300hz
swt = 11.5s
rf att = 20db
ref lvl = –7dbm
图示 30. narrowband (40.1
±
0.1 mhz) 输出 sfdr 为
一个 40.1 mhz 基本的 输出 信号. 系统 时钟 =
180 mhz (6
×
refclk 乘法器 engaged), v
S
= +5 v.
0
–10
–20
–30
–40
–50
–60
–70
–80
–90
–100
2AP
70.1mhz
中心
200kHz
SPAN
20khz/
rbw = 300hz
vbw = 300hz
swt = 11.5s
rf att = 20db
ref lvl = –7dbm
图示 31. narrowband (70.1
±
0.1 mhz) 输出 sfdr 为
一个 70.1 mhz 基本的 输出 信号. 系统 时钟 =
180 mhz (6
×
refclk 乘法器 engaged), v
S
= +5 v.
1
ch1 200mv
T
[]
tek run 4.00gs/s 样本
m 12.5ns ch 1 –200mv
d 200ps runs 之后
: 208ps
@ : 1.940ns
图示 32. 典型 cmos 比较器 p-p 输出 jitter
和 这 ad9851 配置 作 一个 时钟 发生器, dds f
输出
= 10.1 mhz, v
S
= +5 v, 系统 时钟 = 180 mhz, 70 mhz
lpf. 图表 详细信息 这 中心 portion 的 一个 rising 边缘 和
scope 在 delayed 触发 模式, 200 ps/div. cursors 显示
208 ps p-p jitter.
1
ch1 200mv
T
[]
tek run 4.00gs/s 样本
m 12.5ns ch 1 –200mv
d 200ps runs 之后
: 204ps
@ : 3.672ns
图示 33. 典型 cmos 比较器 p-p 输出 jitter
和 这 ad9851 配置 作 一个 时钟 发生器, dds f
输出
= 40.1 mhz, v
S
= +5 v, 系统 时钟 = 180 mhz, 70 mhz
lpf. 图表 详细信息 这 中心 portion 的 一个 rising 边缘 和
scope 在 delayed 触发 模式, 200 ps/div. cursors 显示
204 ps p-p jitter.
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