AD9859
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同步_clk
SYSCLK
AB
数据 2 数据 3
数据 1
数据 在
寄存器
数据 在
i/o 缓存区
数据 1
数据 2 数据 3
i/o 更新
这 设备 寄存器 一个 i/o 更新 在 要点 一个. 这 数据 是 transferred 从 这 asynchronously 承载 i/o 缓存区 在 要点 b.
03374-0-007
图示 20. i/o 同步 定时 图解
同步 多样的 ad9859s
这 ad9859 准许 容易 同步 的 多样的 ad9859s.
那里 是 三 模式 的 同步 有
至 这 用户: 一个 自动 同步 模式, 一个 软件
控制 手工的 同步 模式, 和 一个 硬件
控制 手工的 同步 模式. 在 所有 具体情况, 当 一个
用户 wants 至 同步 二 或者 更多 设备, 这 下列的
仔细考虑 必须 是 observed. 第一, 所有 单位 必须 share 一个
一般 时钟 源. 查出 长度 和 path 阻抗 的 这
时钟 tree 必须 是 设计 至 保持 这 阶段 延迟 的 这 dif-
ferent 时钟 分支 作 closely matched 作 可能. 第二, 这
i/o 更新 信号’s rising edge 必须 是 提供 synchro-
nously 至 所有 设备 在 这 系统. 最终, regardless 的 这
内部的 同步 方法 使用, 这 dvdd_i/o 供应
应当 是 设置 至 3.3 v 为 所有 设备 那 是 至 是 同步.
avdd 和 dvdd 应当 是 left 在 1.8 v.
在 自动 同步 模式, 一个 设备 是 选择 作 一个
主控; 这 其它 设备 是 slaved 至 这个 主控. 当 con-
figured 在 这个 模式, 这 slaves automatically 同步 它们的
内部的 clocks 至 这 同步_clk 输出 信号 的 这 主控
设备. 至 enter 自动 同步 模式, 设置 这 从动装置
设备的 自动 同步 位 (cfr1<23> = 1). con-
nect 这 同步_在 输入(s) 至 这 主控 同步_clk
输出. 这 从动装置 设备 continuously updates 这 阶段 rela-
tionship 的 它的 同步_clk 直到 它 是 在 阶段 和 这
同步_在 输入, 这个 是 这 同步_clk 的 这 主控 设备.
当 attempting 至 同步 设备 运动 在 sysclk
speeds 在之外 250 msps, 这 高 速 同步 增强
使能 位 应当 是 设置 (cfr2<11> = 1).
在 软件 手工的 同步 模式, 这 用户 forces 这
设备 至 进步 这 同步_clk rising 边缘 一个 sysclk
循环 (1/4 同步_clk 时期). 至 活动 这 手工的 synchro-
nization 模式, 设置 这 从动装置 设备的 软件 手工的 synchroni-
zation 位 (cfr1<22> = 1). 这 位 (cfr1<22>) 是 cleared immedi-
ately. 至 进步 这 rising 边缘 的 这 同步_clk 多样的 时间,
这个 位 needs 至 是 设置 多样的 时间.
在 硬件 手工的 同步 模式, 这 同步_在
输入 管脚 是 配置 此类 那 它 advances 这 rising 边缘 的
这 同步_clk 信号 各自 时间 这 设备 发现 一个 rising 边缘
在 这 同步_在 管脚. 至 放 这 设备 在 硬件 手工的
同步 模式, 设置 这 硬件 手工的 synchroniza-
tion 位 (cfr2<10> = 1). 不像 这 软件 手工的 synchro-
nization 位, 这个 位 做 不 自-clear. once 这 硬件
手工的 同步 模式 是 使能, 所有 rising edges de-
tected 在 这 同步_在 输入 导致 这 设备 至 进步 这
rising 边缘 的 这 同步_clk 用 一个 sysclk 循环 直到 这个
使能 位 是 cleared (cfr2<10> = 0).
使用 一个 单独的 结晶 至 驱动 多样的 ad9859 时钟
输入
这 ad9859 结晶 振荡器 输出 信号 是 有 在 这
结晶 输出 管脚, enabling 一个 结晶 至 驱动 多样的
ad9859s. 在 顺序 至 驱动 多样的 ad9859s 和 一个 结晶,
这 结晶 输出 管脚 的 这 ad9859 使用 这 外部 结晶
应当 是 连接 至 这 refclk 输入 的 这 其它 ad9859.
这 结晶 输出 管脚 是 静态的 直到 这 cfr2<9> 位 是 设置,
enabling 这 输出. 这 驱动 力量 的 这 结晶 输出
管脚 是 典型地 非常 低, 所以 这个 信号 应当 是 缓冲 较早的
至 使用 它 至 驱动 任何 负载.
串行 端口 运作
和 这 ad9859, 这 操作指南 字节 specifies 读/写
运作 和 寄存器 地址. 串行 行动 在 这 ad9859
出现 仅有的 在 这 寄存器 水平的, 不 这 字节 水平的. 为 这
ad9859, 这 串行 端口 控制 recognizes 这 操作指南
字节 寄存器 地址 和 automatically 发生 这 恰当的
寄存器 字节 地址. 在 增加, 这 控制 expects 那 所有
字节 的 那 寄存器 将 是 accessed. 它 是 一个 必需的 那 所有
字节 的 一个 寄存器 是 accessed 在 串行 i/o 行动,
和 一个 例外. 这 iosync 函数 能 是 使用 至
abort 一个 i/o 运作, 因此 准许 较少 比 所有 字节
至 是 accessed.
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