LTC1292DCN8_集成电路资料查询网

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ltc1292/ltc1297
如果 v
CC
和 v
REF
是 不 系 一起, 然后 v
CC
应当
是 转变 在 第一, 然后 v
REF
. 如果 这个 sequence 不能 是
符合, 连接 一个 二极管 从 v
REF
至 v
CC
是 recom-
mended (看 图示 25).
因为 一个 唯一的 输入 保护 结构 是 使用 在
这 数字的 输入 管脚, 这 信号 水平 在 这些 管脚 能
超过 这 设备 v
CC
没有 损害的 这 设备.
U
S
一个
O
PP
L
IC
在
I
WU
U
I 为 ATIO
图示 26.  “quick look” 电路 为 这 ltc1292
5V
ltc1292/7 f23
1n4148 二极管
V
CC
CLK
D
输出

V
REF
CS
+IN
–IN
地
LTC1292
LTC1297
5V
ltc1292/7 f24
1n4148 二极管
1k
V
CC
CLK
D
输出

V
REF
CS
+IN
–IN
地
LTC1292
LTC1297
图示 24b. 超（电）压 保护 和
二极管 clamps 和 电流 限制的 电阻
图示 23. 超（电）压 保护 和 clamp 二极管
5V
ltc1292/7 f25
1N4148
5V
V
CC
CLK
D
输出

V
REF
CS
+IN
–IN
地
LTC1292
LTC1297
图示 25.  独立的 v
CC
和 v
REF
供应
5V
ltc1292/7 f24a
250
Ω
1k
V
CC
CLK
D
输出

V
REF
CS
+IN
–IN
地
LTC1292
LTC1297
图示 24a. 超（电）压 保护 和
电流 限制的 电阻器
至 oscilloscope
CD4520
ltc1292/7 f26
Q1
重置
V
DD
EN
CLK
Q2
Q3
Q4
0.1µf
V
在
f/32
+5V
时钟 in
1MHz
22µF
CLK
EN
Q2
Q3
Q4
V
SS
Q1
重置
V
CC
CLK
D
输出

V
REF
CS
+IN
–IN
地
LTC1292

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21 ltc1292/ltc1297 如果 v CC 和 v REF 是不系一起, 然后 v CC 应当是转变在第一, 然后 v REF . 如果这个 sequence 不能是符合, 连接一个二极管从 v REF 至 v CC 是 recom- mended (看图示 25). 因为一个唯一的输入保护结构是使用在这数字的输入管脚, 这信号水平在这些管脚能超过这设备 v CC 没有损害的这设备. U S 一个 O PP L IC 在 I WU U I 为 ATIO 图示 26. “quick look” 电路为这 ltc1292 5V ltc1292/7 f23 1n4148 二极管 V CC CLK D 输出  V REF CS +IN –IN 地 LTC1292 LTC1297 5V ltc1292/7 f24 1n4148 二极管 1k V CC CLK D 输出  V REF CS +IN –IN 地 LTC1292 LTC1297 图示 24b. 超（电）压保护和二极管 clamps 和电流限制的电阻图示 23. 超（电）压保护和 clamp 二极管 5V ltc1292/7 f25 1N4148 5V V CC CLK D 输出  V REF CS +IN –IN 地 LTC1292 LTC1297 图示 25. 独立的 v CC 和 v REF 供应 5V ltc1292/7 f24a 250 Ω 1k V CC CLK D 输出  V REF CS +IN –IN 地 LTC1292 LTC1297 图示 24a. 超（电）压保护和电流限制的电阻器至 oscilloscope CD4520 ltc1292/7 f26 Q1 重置 V DD EN CLK Q2 Q3 Q4 0.1µf V 在 f/32 +5V 时钟 in 1MHz 22µF CLK EN Q2 Q3 Q4 V SS Q1 重置 V CC CLK D 输出  V REF CS +IN –IN 地 LTC1292

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