ADS8325
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SBAS226A
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7FFE
4005
7FFF
476
519
8000
代号
8001
00
7FFD
V
DD
= 5.0v
V
REF
= 5.0v
7FFE
3499
7FFF
683
649
90 79
8000
代号
80017FFD
V
DD
= 2.7v
V
REF
= 2.5v
图示 9. 5000 转换 histogram 的 一个 直流 输入.
图示 10. 5000 转换 histogram 的 一个 直流 输入.
AVERAGING
这 噪音 的 这 一个/d 转换器 能 是 补偿 用
averaging 这 数字的 代号. 用 averaging 转换 结果,
转变 噪音 将 是 减少 用 一个 因素 的 1/
n
, 在哪里 n
是 这 号码 的 averages. 为 例子, averaging 四
转换 结果 将 减少 这 转变 噪音 从
±
0.5lsb 至
±
0.25lsb. averaging 应当 仅有的 是 使用 为
输入 信号 和 发生率 near 直流.
为 交流 信号, 一个 数字的 过滤 能 是 使用 至 低-通过 过滤
和 decimate 这 输出 代号. 这个 工作 在 一个 类似的
manner 至 averaging; 为 每 decimation 用 2, 这 信号-
至-噪音 比率 将 改进 3db.
数字的 接口
信号 水平
这 ads8325 有 一个 宽 范围 的 电源-供应 电压.
这 一个/d 转换器, 作 好 作 这 数字的 接口 电路, 是
设计 至 接受 和 运作 从 2.7v 向上 至 5.5v. 这个
电压 范围 将 accommodate 不同的 逻辑 水平.
当 这 ads8325
’
s 电源-供应 电压 是 在 这 范围 的
4.5v 至 5.5v (5v 逻辑 水平的), 这 ads8325 能 是 连接
直接地 至 另一 5v cmos 整体的 电路.
另一 possibility 是 那 这 ads8325
’
s 电源-供应 volt-
age 是 在 这 范围 的 2.7v 至 3.6v. 这 ads8325 能 是
连接 直接地 至 另一 3.3v lvcmos 整体的 cir-
cuit.
串行 接口
这 ads8325 communicates 和 微处理器 和 其它
数字的 系统 通过 一个 同步的 3-线 串行 接口, 作
illustrated 在 这 定时 图解 和 定时 特性
表格. 这 dclock 信号 synchronizes 这 数据 转移
和 各自 位 正在 transmitted 在 这 下落 边缘 的 dclock.
大多数 接到 系统 将 俘获 这 bitstream 在 这
rising 边缘 的 dclock. 不管怎样, 如果 这 最小 支撑 时间
为 d
输出
是 可接受的, 这 系统 能 使用 这 下落 边缘
的 dclock 至 俘获 各自 位.
一个 下落
CS
信号 initiates 这 转换 和 数据 转移.
这 第一 4.5 至 5.0 时钟 时期 的 这 转换 循环 是
使用 至 样本 这 输入 信号. 之后 这 fifth 下落 dclock
边缘, d
输出
是 使能 和 将 输出 一个 低 值 为 一个
时钟 时期. 为 这 next 16 dclock 时期, d
输出
将
输出 这 转换 结果, 大多数 重大的 位 第一. 之后
这 least 重大的 位 (b0) 有 被 输出, subsequent
clocks 将 repeat 这 输出 数据, 但是 在 一个 least 重大的 位
第一 format.
之后 这 大多数 重大的 位 (b15) 有 被 重复的, d
输出
将 触发-状态. subsequent clocks 将 有 非 效应 在 这
转换器. 一个 新 转换 是 initiated 仅有的 当
CS
有
被 带去 高 和 returned 低.
数据 format
这 输出 数据 从 这 ads8325 是 在 笔直地 二进制的
format (看 图示 11). 这个 图示 代表 这 完美的
输出 代号 为 一个 给 输入 电压 和 做 不 包含
这 影响 的 补偿, 增益 错误, 或者 噪音.
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