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10 Communications 处理器 介绍
(持续)
14 数据 流动
这 CPU 寄存器 是 所有 双 port 那 is 它们 有 sepa-
比率 输入 和 输出 paths 这个 arrangement 准许 一个 sin-
gle 寄存器 至 函数 作 两个都 一个 源 和 一个 destination
在里面 这 一样 instruction
计算数量 1-6a
通过
1-6f
显示 这 内部的 数据 流动 path
为 这 BCP 这 CPU 寄存器 是 一个 central 元素 至 这个
path 当 一个 寄存器 功能 作 一个 output 它的 内容
是 放置 在 这 源 bus 当 一个 寄存器 是 一个 input
数据 从 这 Destination 总线 是 写 在 那 register
这 其它 关键 元素 在 这 数据 path 是 这 ALU 这个 单位
做 所有 的 这 arithmetic 和 数据 manipulation operations
但是 它 也 有 总线 multiplexing capabilities 两个都 这 数据
记忆 总线 和 一个 portion 的 这 操作指南 记忆 总线
是 routed 至 这个 单位 和 提供 作 alternative 来源 的
data 自从 这 数据 流动 是 总是 通过 这个 unit 大多数
数据 moves 将 包含 arithmetic manipulations 和 非
penalty 在 执行 time
图示 1-6a
显示 这 数据 path 为 所有 arithmetic instruc-
tions 和 寄存器 至 寄存器 moves 这 源 寄存器
内容 是 放置 在 这 源 bus routed 通过 这
TLF9336–C3 TLF9336–C4
TLF9336–C5
图示 1-6a 寄存器 至 寄存器 图示 1-6b 数据 记忆 写 图示 1-6c 数据 记忆 读
TLF9336–C6 TLF9336–C7 TLF9336–C8
图示 1-6d 写 至 传输者 图示 1-6e 读 从 接受者 图示 1-6f 加载 立即的 数据
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10 Communications 处理器介绍 (持续) 14 数据流动这 CPU 寄存器是所有双 port 那 is 它们有 sepa- 比率输入和输出 paths 这个 arrangement 准许一个 sin- gle 寄存器至函数作两个都一个源和一个 destination 在里面这一样 instruction 计算数量 1-6a 通过 1-6f 显示这内部的数据流动 path 为这 BCP 这 CPU 寄存器是一个 central 元素至这个 path 当一个寄存器功能作一个 output 它的内容是放置在这源 bus 当一个寄存器是一个 input 数据从这 Destination 总线是写在那 register 这其它关键元素在这数据 path 是这 ALU 这个单位做所有的这 arithmetic 和数据 manipulation operations 但是它也有总线 multiplexing capabilities 两个都这数据记忆总线和一个 portion 的这操作指南记忆总线是 routed 至这个单位和提供作 alternative 来源的 data 自从这数据流动是总是通过这个 unit 大多数数据 moves 将包含 arithmetic manipulations 和非 penalty 在执行 time 图示 1-6a 显示这数据 path 为所有 arithmetic instruc- tions 和寄存器至寄存器 moves 这源寄存器内容是放置在这源 bus routed 通过这 TLF9336–C3 TLF9336–C4 TLF9336–C5 图示 1-6a 寄存器至寄存器图示 1-6b 数据记忆写图示 1-6c 数据记忆读 TLF9336–C6 TLF9336–C7 TLF9336–C8 图示 1-6d 写至传输者图示 1-6e 读从接受者图示 1-6f 加载立即的数据 11

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