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资料编号:266944
 
资料名称:DS2181A
 
文件大小: 376.61K
   
说明
 
介绍:
CEPT Primary Rate Transceiver
 
 


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DS2181A
12 的 32
fixed 框架 resync criteria
当 使能 通过 rcr.1, 这 设备 将 automatically initiate 框架 搜索 whenever 这 框架
排成直线 文字 是 received 在 错误 三 consecutive 时间.
fixed cas multiframe resync criteria
当 使能 通过 rcr.1, 这 设备 将 automatically initiate 框架 搜索 whenever 二 consecutive
cas multiframe 排成直线 words 是 received 在 错误.
fixed crc4 resync criteria
如果 ccr.1=1 或者 如果 这 测试 管脚 是 系 高, 然后 这 ds2181a 将 initiate 这 resync 在 这 fas 水平的 如果
cas signalling 源
cas 产品 样本 signaling 数据 在 tser 当 tcr.6 = 0; 一个 在-碎片 数据 多路调制器 accepts
频道-有关联的 数据 输入 在 tsd 当 tcr.6 = 1. 这 数据 多路调制器 必须 是 无能 (tcr.6 =
0) 当 这 ccs 模式 是 使能 (tcr.5 = 1).
tsd 输入 定时 (tcr.6 = 1; tcr.5 = 0) 表格 6
框架 # timeslot signaling
数据 抽样 在 tsd
017
1 1, 18
2 2, 19
3 3, 20
4 4, 21
5 5, 22
6 6, 23
7 7, 24
8 8, 25
9 9, 26
10 0, 27
11 11, 28
12 12, 29
13 13, 30
14 14, 31
15 15
便条:
1.
一个, b, c 和 d 数据 是 抽样 在 下落 edges 的 tclk 在 位 时间 5, 6, 7 和 8 的 timeslots
表明.
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