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VP1D[10]
VP1D[11]
vp1d[12]/axr0[0]
vp1d[13]/axr0[1]
vp1d[14]/axr0[2]
vp1d[15]/axr0[3]
vp1d[16]/axr0[4]
vp1d[17]/axr0[5]
VP1D[0]
VP1D[1]
vp1d[2]/clkx1
vp1d[3]/fsx1
vp1d[4]/dx1
vp1d[5]/clks1
vp1d[6]/dr1
vp1d[7]/fsr1
vp1d[8]/clkr1
VP1D[9]
vp1d[18]/axr0[6]
vp1d[19]/axr0[7]
俘获/显示
缓存区
(2560 字节)
VP1CLK0
VP1CLK1
VP1CTL0
VP1CTL1
VP1CTL2
Timing 和
控制 逻辑
Video 端口 1 (vp1)
频道 b
(b)
频道 一个
(一个)
俘获/显示
缓存区
(2560 字节)
频道 b 使用 仅有的
这 vp1d[19:10]
双向的 管脚
STCLK
(c)
TMS320DM642
video/imagingfixed-pointdigitalsignalprocessor
SPRS200J–JULY2002–REVISEDAUGUST2005
一个.channelasupports:bt.656(8/10-位),y/cvideo(16/20-位),rawvideo(16/20-位)displaymodesandbt.656
(8/10-位),y/cvideo(16/20-位),rawvideo(16/20-位),andtsi(8-bit)capturemodes.
b.channelbsupports:bt.656(8/10-位),rawvideo(8/10-位)capturemodesandcandisplaysynchronizedraw
videodatawithchannela.
c.thesamestclksignalisusedforallthreevideoports(vp0,vp1,andvp2).
figure2-13.videoport1peripheralsignals
DeviceOverview
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