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balance 和 准许 这 接受者 至
维持 频率 和 阶段
锁. 这 类型 的 fill frames sent
(ff0 或者 ff1) 是 决定 用 这
ff 输入. 在 一个 duplex 系统, ff
是 正常情况下 连接 至 这 rx’s
stat1 管脚.
这 c-地方 encoder, 为基础 在
这 输入 在 dav*, cav*,
flagsel, 和 标记, 供应
四 encoded 位 至 这 框架
mux. 这个 encoded 数据 包含
这 主控 转变 (这个 这
接受者 使用 为 频率
locking), 作 好 作 信息
关于 这 数据 类型: 控制,
数据, 或者 fill 框架. 在 顺序 为 这
标记 位 至 是 使用 作 一个
额外的 数据 位, flagsel
必须 是 设置 高 为 两个都 这 tx
和 这 rx.
d-地方 encoder
这 d-地方 encoder 提供 这
remaining 并行的 文字 数据 至
这 框架 mux. 为基础 在 控制
信号 从 这 控制 逻辑,
这 d-地方 encoder 也
输出 这 并行的 信息 在
它的 数据 输入 (d0..d19) 或者 这
designated fill 框架. rst*,
当 设置 低, resets 这 内部的
碎片 寄存器.
框架 mux
这 框架 mux accepts 这
输出 从 这 c-地方 和 d-
地方 encoders. 这 四 控制
位 是 连结 至 这 数据 位,
也 16 或者 20 数据 位 为基础 在
这 m20sel 输入. 这个 并行的
信息, now 也 20 或者 24
位 宽, 是 多路复用 至 一个
串行 线条 为基础 在 这 内部的
高 速 串行 时钟.
SIGN
这 sign 电路系统 确定 这
cumulative sign 的 这 优于
数据 框架, containing 这 数据
和 控制 位. 这个 是 使用 用
这 accumulator/反相器 至
维持 直流 balance 为 这
传递 线条.
accumulator/invert
这 accumulator/invert 块 是
有责任 为 维持 这
直流 balance 的 这 串行 线条. 它
确定, 为基础 在 history 和
这 sign 的 这 电流 数据 框架,
whether 或者 不 这 电流 框架
应当 是 inverted 至 bring 这
线条 closer 至 这 desired 50%
职责 循环. inv 是 设置 高 当
这 数据 框架 是 inverted.
输出 选择
在 正常的 运作, 这 串行
数据 stream 是 放置 在 dout.
用 asserting loopen, 这 用户
将 也 直接 这 串行 数据
stream 至 lout, 这个 将 是
使用 为 loopback 测试. 当
loopen 是 不 asserted, lout 是
无能 至 减少 电源
消耗量.
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