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资料编号:378404
 
资料名称:HI1-574AJD-5
 
文件大小: 200.42K
   
说明
 
介绍:
Complete, 12-Bit A/D Converters with Microprocessor Interface
 
 


: 点此下载
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本平台电子爱好着纯手工中文简译:截至2020/5/17日,支持英文词汇500个
6-966
这 12/
8 输入 将 是 系 高 或者 低 在 大多数 产品,
though 它 是 全部地 ttl/cmos-兼容. 和 12/
8 高, 所有
12 输出 线条 变为 起作用的 同时发生地, 为 接口 至
一个 12-位 或者 16-位 数据 总线. 这 一个
O
输入 是 ignored.
和 12/
8 低, 这 输出 是 有组织的 在 二 8-位 字节,
选择 一个 在 一个 时间 用 一个
O
. 这个 准许 一个 8-位 数据 总线
至 是 连接 作 显示 在 图示 6. 一个
O
是 通常地 系 至
这 least significant 位 的 这 地址 总线, 为 storing 这
hi-x74(一个) 输出 在 二 consecutive 记忆 locations.
(和 一个
O
低, 这 8 msbs 仅有的 是 使能. 和 一个
O
高, 4
msbs 是 无能, 位 4 通过 7 是 强迫 低, 和 这 4
lsbs 是 使能). 这个 二 字节 format 是 考虑 “left
justified 数据,” 为 这个 一个 decimal (或者 binary!) 要点 是
assumed 至 这 left 的 字节 1:
更远, 一个
O
将 是 toggled 在 任何 时间 没有 损坏 至
这 转换器. 破裂-在之前-制造 action 是 有保证的
在 这 二 数据 字节, 这个 assures 那 这 输出
strapped 一起 在 图示 6 将 从不 是 使能 在 这
一样 时间.
一个 读 运作 通常地 begins 之后 这 转换 是
完全 和 sts 是 低. 为 earliest 进入 至 这 数据,
不管怎样, 这 读 应当 begin 非 后来的 比 (t
DD
+ t
HS
)
在之前 sts 变得 低. 看 图示 5.
字节 1 字节 2
XXXXXXXX XXXX0000
MSB LSB
看 hi-774 定时 specifications 为 更多 信息.
图示 4. 转变 开始 定时
CE
CS
r/
C
一个
O
STS
db11-db0
t
SSC
t
SRC
t
HEC
t
HSC
t
SAC
t
HAC
t
DSC
t
C
高 阻抗
t
HRC
看 hi-774 定时 specifications 为 更多 信息.
图示 5. 读 循环 定时
图示 6. 接口 至 一个 8-位 数据 总线
CE
CS
r/
C
一个
O
STS
db11-db0
高 阻抗
t
SSR
t
SRR
t
SAR
t
HS
t
HD
t
HL
t
DD
t
HAR
t
HRR
t
HSR
数据
有效的
1
2
3
4
5
6
7
8
9
10
11
12
13
14
28
27
26
25
24
23
22
21
20
19
18
17
16
15
STS
db11 (msb)
db0 (lsb)
dig.
com.
hi-774
12/
8
一个
O
一个
O
数据
总线
地址 总线
hi-574a, hi-674a, hi-774
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