HI3-5701K-5_集成电路资料查询网

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定时 波形
图示 1. 输入-至-输出 定时
图示 2. 输出 使能 定时
n - 2
比较器 数据
是 latched
encoded 数据 是
latched 在 这
输出 寄存器
t
AP
t
AJ
t
H
t
OD
数据 n - 4 数据 n - 3 数据 n - 2 数据 n - 1 数据 n
时钟
输入
阶段 - 高
时钟
输入
阶段 - 低
相似物
输入
数据
输出
φ
2
φ
2
φ
2
φ
2
φ
1
φ
1
φ
1
φ
1
样本
自动
BALANCE
t
AB
样本
n - 1
自动
BALANCE
样本
N
自动
BALANCE
样本
n + 1
自动
BALANCE
样本
n + 2
φ
2
t
S
CE1
CE2
D0
-
D5
OVF
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DIS
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EN
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高
阻抗
高
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数据
数据数据
数据 数据
高
阻抗
hi-5701

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5 定时波形图示 1. 输入-至-输出定时图示 2. 输出使能定时 n - 2 比较器数据是 latched encoded 数据是 latched 在这输出寄存器 t AP t AJ t H t OD 数据 n - 4 数据 n - 3 数据 n - 2 数据 n - 1 数据 n 时钟输入阶段 - 高时钟输入阶段 - 低相似物输入数据输出 φ 2 φ 2 φ 2 φ 2 φ 1 φ 1 φ 1 φ 1 样本自动 BALANCE t AB 样本 n - 1 自动 BALANCE 样本 N 自动 BALANCE 样本 n + 1 自动 BALANCE 样本 n + 2 φ 2 t S CE1 CE2 D0 - D5 OVF t DIS t EN t DIS t EN 高阻抗高阻抗数据数据数据数据数据高阻抗 hi-5701

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