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接受者 parity 状态:
0 = odd parity
1 = 甚至 parity
如果 这 接受者 输入 数据 文字 string 是 broken 在之前 这
全部 数据 文字 是 received, 这 接受者 将 重置 和
ignore 这 partially received 数据 文字.
如果 这 传输者 是 使用 至 transmit consecutive 数据 words,
各自 文字 将 是 separated 用 一个 四 (4) 位 “null” 状态 (两个都
积极的 和 负的 输出 将 维持 一个 零 (0) volt
水平的.)
接受者 parity 状态:
0 = odd parity
1 = 甚至 parity
非 源/destination (s/d) 在 25-位 format.
接受者 运作
自从 这 二 接受者 是 functionally 完全同样的, 仅有的 一个
将 是 discussed 在 detail, 和 这 块 图解 将 是
使用 为 涉及 在 这个 discussion. 这 接受者 组成
的 这 下列的 电路:
• 这
线条 接受者
功能 作 一个 电压 水平的 翻译.
它 transforms 这 10 volt 差别的 线条 电压, arinc
429 format, 在 5 volt 内部的 逻辑 水平的.
• 这 输出 的 这 线条 接受者 是 一个 的 二 输入 至 这
自-测试 数据 选择 (sel)
. 这 其它 输入 至 这
数据 选择 是 这 自-测试 信号 从 这 传输者
部分.
• 这 新当选的 数据, 也 自-测试 或者 arlnc 429, 是
翻倍 抽样 用 这
文字 间隙 计时器
至 发生 一个
数据 时钟. 这 接受者 样本 频率 (rcvclk),
1mhz, 或者 125khz, 是 发生 用 这 接受者/transmit-
ter 定时 电路. 这个 抽样 频率 是 ten 时间 这
数据 比率 至 确保 非 数据 ambiguity.
• 这 获得 数据 时钟 然后 shifts 这 数据 向下 一个 32-位
长
数据 变换 寄存器
(数据 s/ri). 这 数据 文字
长度 是 可选择的 为 也 25 位 或者 32 位 长 用 这
控制 信号 (wlsel). 作 soon 作 这 数据 文字 是
完全地 received, 一个 内部的 信号 (wdcnt1) 是 gen-
erated 用 这 文字 间隙 计时器 电路.
• 这 源/destination (s/d) 解码器 比较 这 用户
设置 代号 (x 和 y) 和 位 9 和 10 的 这 数据 文字. 如果
这 二 代号 是 matched, 一个 积极的 信号 是 发生
至 使能 这 wdcnt1 信号 至 获得 在 这 received 数据.
否则, 这 数据 文字 是 ignored 和 非 闭锁 action
takes 放置. 这 s/d 解码器 能 是 使能 和
无能 用 这 控制 信号 s/d enb. 如果 这 数据 文字 是
latched, 一个 指示信号 flag (
d/r1) 是 设置. 这个 indicates 一个
有效的 数据 文字 是 准备好 至 是 fetched 用 这 用户.
• 之后 这 接受者 数据 有 被 shifted 向下 这 变换
寄存器, 它 是 放置 在 一个 支持 寄存器. 这 设备 准备好
flag 将 然后 是 设置 表明 那 数据 是 准备好 至 是
fetched. 如果 这 数据 是 ignored 和 left 在 这 支持 regis-
ter, 它 将 是 写 在 当 这 next 数据 文字 是
received.
• 这 received 数据 在 这 32-位 支持 寄存器 是 放置
在 这 总线 在 这 表格 的 二 (2)16-位 words regardless 的
whether 这 format 是 为 32 或者 25-位 数据 words. 也
文字 能 是 accessed first 或者 repeatedly 直到 这 next
received 数据 文字 falls 在 这 支持 寄存器.
• 这 parity 的 这 新当选的 文字 是 审查 和 这 状态
(i.e., 逻辑 “0” 为 odd parity 和 逻辑 “1” 为 甚至 parity)
贮存 在 这 接受者 获得 和 输出 在 bd08 在 这
文字 非. 1.
• 假设 这 用户 desires 至 进入 这 数据, he first sets
这 数据 选择 线条 (sel) 至 一个 逻辑 “0” 水平的 和 脉冲
这 使能 (
en1) 线条. 这个 action 导致 这 数据
选择 (卖) 至 选择 这 first-数据 文字, 这个 con-
tains 这 label field 和 使能 它 面向 这 数据 总线. 至
获得 这 第二 数据 文字, 这 用户 sets 这 sel 线条 至
一个 逻辑 “1” 水平的 和 脉冲波 这 使能 (
en1) 线条 又一次.
这 使能 脉冲波 持续时间 是 matched 至 这 用户 电路
必要条件 需要 至 读 这 数据 文字 从 这 数据
总线. 这 第二 使能 脉冲波 是 也 使用 至 重置 这
设备 准备好 (
d/r1) flip-flop. 这个 完成 一个 接到
循环.
表格 2b. 文字 2 format
bi-directional
BlT# 函数 arinc bit#
15 Sign 29
14 MSB 28
13 - 00 数据 27 - 14
表格 3. arinc 25-位 数据 format
arinc 位 # 函数
1 - 8 Label
9 LSB
11 - 23 数据
24 MSB
25 parity 状态
表格 4a. 文字 1 format
bi-directional
BIT# 函数 arinc bit#
15 - 9 don’t 小心 XXX
8 parity 状态 25
7 - 0 Label 1 - 8
表格 4b. 文字 2 format
bi-directional
BIT# 函数 arinc blt#
15 MSB 24
14 - 1 数据 23 -10
0 LSB 9
hs-3282
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