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资料编号:405978
 
资料名称:IP80C88-2
 
文件大小: 246.44K
   
说明
 
介绍:
CMOS 8/16-Bit Microprocessor
 
 


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3-16
交流 电的 specifications
V
CC
= 5.0v
±
10%; T
一个
= 0
o
c 至 +70
o
c (c80c88, c80c88-2)
V
CC
= 5.0v
±
100%; T
一个
= -40
o
c 至 +85
o
c (i80c88, i80c88-2)
V
CC
= 5.0v
±
100%; T
一个
= -55
o
c 至 +125
o
c (m80c88)
V
CC
= 5.0v
±
5%; T
一个
= -55
o
c 至 +125
o
c (m80c88-2)
最小 complexity 系统
标识 参数
80C88 80c88-2
单位
测试
CONDITIONSMIN 最大值 最小值 最大值
定时 (所需的)东西
(1) TCLCL clk 循环 时期 200 - 125 - ns
(2) TCLCH clk 低 时间 118 - 68 - ns
(3) TCHCL clk 高 时间 69 - 44 - ns
(4) TCH1CH2 clk 上升 时间 - 10 - 10 ns 1.0v 至 3.5v
(5) TCL2CL1 clk 失败 时间 - 10 - 10 ns 从 3.5v 至 1.0v
(6) TDVCL 数据 在 建制 时间 30 - 20 - ns
(7) TCLDX1 数据 在 支撑 时间 10 - 10 - ns
(8) TR1VCL rdy 建制 时间 在 82c84a
(注释 6, 7)
35 - 35 - ns
(9) TCLR1X RDY 支撑 时间 在 82C84A
(注释 6, 7)
0-0-ns
(10) TRYHCH 准备好 建制 时间 在 80c88 118 - 68 - ns
(11) TCHRYX 准备好 支撑 时间 在 80c88 30 - 20 - ns
(12) TRYLCL 准备好 inactive 至 clk (便条 8) -8 - -8 - ns
(13) THVCH 支撑 建制 时间 35 - 20 -
n
s
(14) TINVCH lntr, nmi, 测试 建制 时间
(便条 7)
30 - 15 - ns
(15) TILIH 输入 上升 时间 (除了 clk) - 15 - 15 ns 从 0.8v 至 2.0v
(16) TIHIL 输入 失败 时间 (除了 clk) - 15 - 15 ns 从 2.0v 至 0.8v
定时 responses
(17) TCLAV 地址 有效的 延迟 10 110 10 60 ns cl = 100pf
(18) TCLAX 地址 支撑 时间 10 - 10 - ns cl = 100pf
(19) TCLAZ 地址 float 延迟 TCLAX 80 TCLAX 50 ns cl = 100pf
(20) TCHSZ 状态 float 延迟 - 80 - 50 ns cl = 100pf
(21) TCHSV 状态 起作用的 延迟 10 110 10 60 ns cl = 100pf
(22) TLHLL ale 宽度 tclch-20 - tclch-10 - ns cl = 100pf
(23) TCLLH ale 起作用的 延迟 - 80 - 50 ns cl = 100pf
(24) TCHLL ale inactive 延迟 - 85 - 55 ns cl = 100pf
80C88
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