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资料编号:445893
 
资料名称:AD73311LARS
 
文件大小: 382.23K
   
说明
 
介绍:
Low Cost, Low Power CMOS General Purpose Analog Front End
 
 


: 点此下载
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本平台电子爱好着纯手工中文简译:截至2020/5/17日,支持英文词汇500个
rev. 一个
AD73311L
–19–
当 使用 这 indirectly 结合 框架 同步 con
guration 在
倾泻 运作 它 是 需要 至 是 知道 的 这 restrictions
在 sending 数据 至 所有 设备 在 这 cascade. effectively 这 时间
允许 是 给 用 这 抽样 间隔 (256/dmclk) 这个
是 15.625
µ
s 为 一个 样本 比率 的 64 khz. 在 这个 间隔, 这
dsp 必须 转移 n
×
16 位 的 信息 在哪里 n 是 这
号码 的 设备 在 这 cascade. 各自 位 将 引领 1/sclk
和, 准许 为 任何 latency 在 这 receipt 的 这 rx
中断 和 这 传递 的 这 tx 数据, 这 relationship
为 successful 运作 是 给 用:
256
/dmclk
>
((
N
×
16
/sclk
)
+ t
中断 latency
)
这 中断 latency 将 包含 这 时间 在 这 模数转换器
抽样 事件 和 这 rx 中断 正在 发生 在 这
DSP
这个 应当 是 16 sclk 循环.
在 cascade 模式,各自 设备 必须 know 这 号码 的设备
在 这 cascade 因为 这 数据 和 mixed 模式 使用 一个 方法
的 counting 输入 框架 同步 脉冲 至 decide 当 它们 应当
更新 这 dac 寄存器 从 这 串行 输入 寄存器. 控制
寄存器 一个 c
用 这 dsp 在 这 程序编制 阶段. 这default condi-
tion 是 那 这
eld 包含 000b, 这个 是 相等的 至 一个
单独的 设备 在cascade (看 表格 xviii).不管怎样, 为 cascade
运作 这个
eld 必须 包含 一个 二进制的 值 那 是 一个 较少
比 这 号码 的 设备 在 这 cascade.
表格 xviii. 设备 计数 settings
DC2 DC1 DC0 cascade 长度
000 1
001 2
010 3
011 4
100 5
101 6
110 7
111 8
效能
作 这 ad73311l 是 设计 至 提供 高 效能, 低
费用 转换, 它 是 重要的 至 understand 这 意思 用
这个 这个 高 效能 能 是达到 在 一个 典型 applica-
tion. this 部分 将, 用 意思 的 谱的 graphs, 外形 这
典型 效能 的 这 设备 和 highlight 一些 的 这
选项 有 至 用户 在 实现 它们的 desired 样本
比率, 也 直接地 在 这 设备 或者 用 做 一些 邮递-处理
在 这 dsp, 当 也 表明 这 有利因素 和 disadvan-
tages 的 这 不同的 approaches.
encoder 部分
这 ad73311l 提供 一个 能变的 抽样 比率 从 一个
xed
mclk 频率
和 64 khz, 32 khz, 16 khz 和 8 kHz
正在 有 和 一个 16.384 mhz 外部 时钟. 各自 的 这些
抽样 比率 preserves 这 一样 抽样 比率 在 这 模数转换器
s
sigma-delta modulator, which 确保 那 这 噪音效能
是 优化 在 各自 情况. 这 examples 在下 将 显示 这
效能 的 一个 1 khz sine 波 当 转变 在 这 各种各样的
样本 比率.
这 范围 的 抽样 比率 是 aimed 至 提供 这 用户 一个 程度
的 flexibility 在 deciding 如何 它们的 相似物 front 终止 是 至 是
执行. 这 高 样本 比率 的 64 khz 和 32 khz 是
suited 至 那些 产品, 此类 作 起作用的 控制, 在哪里 低
转换 组 延迟 是 essential. 在 这 其它 hand, 这
更小的 样本 比率 的 16 khz 和 8 khz 是 更好的 suited 为
产品 此类 作 telephony, 在哪里 这 更小的 样本 比率
结果 在 更小的 dsp overhead.
图示 15 显示 这 spectrum 的 这 1 khz 测试 声调 抽样 在
64 khz. 这 plot 显示 这 典型的 shaped 噪音 floor 的
一个 sigma-delta 转换器, 这个 是 initially flat 在 这 带宽 的
interest 但是 然后 rises 和 increasing 频率. 如果 一个 合适的
数字的
lter 是 应用 至 这个 spectrum, 它 是 可能 至 eliminate
这 噪音 floor 在 这 高等级的 发生率. 这个 信号 能 然后 是
使用 在 dsp algorithms 或者 能 是 更远processed 在 一个 deci-
mation algorithm 至 减少 这 有效的 样本 比率. 图示 16
显示 这 结果 spectrum 下列的 这
ltering 和 decima-
tion 的 这 spectrum 的 图示 15 从 64 khz 至 一个 8 khz 比率.
频率
Hz
0 0.5
0
dB
20
1.0 1.5 2.0 2.5 3.0 3.5
100
140
120
40
60
80
10
4
图示 15. fft (模数转换器 64 khz 抽样)
频率
Hz
0 500
0
20
dB
40
60
80
100
120
1000 1500 2000 2500 3000 3500 4000
图示 16. fft (模数转换器 8 khz filtered 和 decimated 从
64 khz)
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