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初步的
PTAG
小包装板盒 tag
输出, 高 阻抗, 起作用的 低
PTAGindicates 当 这 状态 框架 是 正在 trans-
mitted 在 pdat. 它 是 asserted 当 这 状态 框架
是 transmitted.
微处理器 接口
d[7:0]
微处理器 数据
输入/输出
这些 管脚 是 输入 当 也 cs 或者 wr 是 低.
这y 是 输出 当 cs
和 rd 是 低. 其它-
wise, 这些 管脚 是 高 阻抗.
CS
碎片 选择
输入, 起作用的 低
这个 管脚 使能 这 imr2 设备 至 读 从 或者 写
至 这 微处理器 数据 总线.
c/d
控制/数据
输入
这个 管脚 是 使用 至 选择 也 一个 控制 寄存器 或者 一个
数据 寄存器 在 这 imr2 设备 和 是 正常情况下 con-
nected 至 这 least significant 位 的 这 地址 总线.
RD
读 strobe
输入, 起作用的 低
initiates 读 运作.
WR
写 strobe
输入, 起作用的 低
initiates 写 运作.
RDY
准备好
输出, 起作用的 高, 打开 流
RDy 是 驱动 低 在 这 开始 的 每 读 或者
写 循环. rdy 是 released 当 这 imr2 设备
是 准备好 至 完全 这 transaction.
INT
中断
输出, 起作用的 低, 打开 流
这 中断 管脚 是 驱动 低 当 任何 的 这 un-
掩饰ed (使能) 中断 出现.
led 接口
ld[7:0]
led 驱动器
输出
ld 是 这 状态 输出 和 是 transmitted 作 2 字节.
这 字节 号码 (高 或者 低) 是 决定 用 bsel.
BSEL
字节 选择
输出
当 bsel 是 低, ld[7:0] 是 transmitting 这 状态
的 这 first 第八 paui 端口 (端口 p
7
通过 p
0
). 当
bsel 是 高, ld[7:0] 是 transmitting 这 状态 的 这
rest 的 这 paui 端口 (端口 p
11
通过 p
8
), 这 aui
port, 这 raui 端口, 和 这 expansion 总线.
CRS
运输车 sense strobe
输出
当 crs 是 高, ld [7:0] 有 运输车 sense 状态.
COLX
collision 状态
输出
当 colx 是 高, ld [7:0] 有 collision 状态.
部分
partitioning 状态
输出
当 部分 是 高, ld [7:0] 有 partitioning 状态.
LINK
link 状态
输出
当 link 是 高, ld [7:0] 有 link 状态.
POL
极性 状态
输出
当 pol 是 高, ld [7:0] 有 极性 状态.
miscellaneous 管脚
RST
重置
输入
当 rst是 低, 这 imr2 设备 resets 至 它的
default 状态.
MCLK
主控 时钟
输入
mclk 是 一个 20-mhz 时钟 输入.
transceiver 设备 接口
sdata [3:0]
串行 数据
输入/输出
SDAT一个 carries command 和 状态 数据 在 这
imr2 设备 和 这 安静 设备 (或者 其它
连接 transceiver).
管脚 transceiver 端口
sdata [0] paui [3:0]
sdata [1] paui [7:4]
sdata [2] paui [11:8]
sdata [3] arbitrary 端口
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