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资料编号:45564
 
资料名称:CY7C1350G-133AXC
 
文件大小: 298.9K
   
说明
 
介绍:
4-Mbit (128K x 36) Pipelined SRAM with NoBL Architecture
 
 


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本平台电子爱好着纯手工中文简译:截至2020/5/17日,支持英文词汇500个
初步的
CY7C1350G
文档 #: 38-05524 rev. *a 页 5 的 15
DQP
[a:d]
. 在 增加, 这 地址 为 这 subsequent 进入
(读/写/deselect) 是 latched 在 这 地址 寄存器
(提供 这 适合的 控制 信号 是 asserted).
在 这 next 时钟 上升 这 数据 提交 至 dqs
和 dqp
[a:d]
(或者 一个 subset 为 字节 写 行动, 看 写 循环
描述 表格 为 详细信息) 输入 是 latched 在 这 设备
和 这 写 是 完全.
这 数据 写 在 这 写 运作 是 控制 用
BW
[a:d]
信号. 这 cy7c1350g 提供 字节 写
能力 那 是 描述 在 这 写 循环 描述 表格.
asserting 这 写 使能 输入 (我们) 和 这 选择 字节
写 选择 (bw
[a:d]
) 输入 将 selectively 写 至 仅有的 这
desired 字节. 字节 不 选择 在 一个 字节 写
运作 将 仍然是 unaltered. 一个 同步的 自-安排时间
写 mechanism 有 被 提供 至 使简化 这 写
行动. 字节 写 能力 有 被 包含 在 顺序 至
非常 使简化 读/modify/写 sequences, 这个 能 是
减少 至 简单的 字节 写 行动.
因为 这 cy7c1350g 是 一个 一般 i/o 设备, 数据
应当 不 是 驱动 在 这 设备 当 这 输出 是
起作用的. 这 输出 使能 (oe
) 能 是 deasserted 高
在之前 presenting 数据 至 这 dqs
和 dqp
[a:d]
输入. 做
所以 将 触发-状态 这 输出 驱动器s. 作 一个 安全 precaution, dqs
和 dqp
[a:d]
是 automatically 触发-陈述 在 这 数据
portion 的 一个 写 循环, regardless 的 这 状态 的 oe
.
burst 写 accesses
这 cy7c1350g 有 一个 在-碎片 burst 计数器 那 准许 这
用户 这 能力 至 供应 一个 单独的 地址 和 conduct 向上 至
四 写 行动 没有reasserting 这 地址 输入.
adv/ld
必须 是 驱动 低 在 顺序 至 加载 这 最初的
地址, 作 描述 在 the 单独的 写 进入 部分
在之上. 当 adv/ld是 驱动 高 在 这 subsequent 时钟
上升, 这 碎片 使能 (ce
1
, ce
2
, 和 ce
3
) 和 我们输入 是
ignored 和 这 burst counter 是 incremented. 这 准确无误的
BW
[a:d]
输入 必须 是 驱动 在 各自 循环 的 这 burst 写
在 顺序 至 写 这 准确无误的 字节 的 数据.
睡眠 模式
这 zz 输入 管脚 是 一个 异步的 输入. asserting zz
places 这 sram 在 一个 电源 conservation “sleep” 模式. 二
时钟 循环 是 必需的 至 enter 在 或者 exit 从 这个 “sleep”
模式. 当 在 这个 模式,数据 integrity 是 有保证的.
accesses pending 当 进去 这 “sleep” 模式 是 不
考虑 有效的 也不 是 这 completion 的 这 运作
有保证的. 这 设备 必须 是 deselected 较早的 至 进去
这 “sleep” 模式. ce
1
, ce
2
, 和 ce
3
, 必须 仍然是 inactive
为 这 持续时间 的 t
ZZREC
之后 这 zz 输入 returns 低.
interleaved burst 地址 表格
(模式 = floating 或者 v
DD
)
第一 地址
a1, a0
第二
地址
a1, a0
第三
地址
a1, a0
Fourth
地址
a1, a0
00 01 10 11
01 00 11 10
10 11 00 01
11 10 01 00
直线的 burst 地址 表格 (模式 = 地)
第一 地址
a1, a0
第二
地址
a1, a0
第三
地址
a1, a0
Fourth
地址
a1, a0
00 01 10 11
01 10 11 00
10 11 00 01
11 00 01 10
真实 表格
[2, 3, 4, 5, 6, 7, 8]
运作 地址 使用 CE ZZ adv/ld 我们 BW
x
OE CEN CLK DQ
deselect 循环 毫无 H L L X X X L l-h 触发-状态
continue deselect 循环 毫无 X L H X X X L l-h 触发-状态
读 循环 (begin burst) External L L L H X L L l-h 数据 输出 (q)
读 循环 (continue burst) Next X L H X X L L l-h 数据 输出 (q)
nop/dummy 读 (begin burst) 外部 L L L H X H L l-h 触发-状态
dummy 读 (continue burst) Next X L H X X H L l-h 触发-状态
写 循环 (begin burst) 外部 L L L L L X L l-h 数据 在 (d)
写 循环 (continue burst) Next X L H X L X L l-h 数据 在 (d)
nop/写 abort (begin burst) 毫无 L L L L H X L l-h 触发-状态
写 abort (continue burst) Next X L H X H X L l-h 触发-状态
ignore 时钟 边缘 (stall) 电流 X L X X X X H l-h
snooze 模式 毫无 X H X X X X X X 触发-状态
注释:
2. x =”don't 小心.” h = 逻辑 高, l = 逻辑 低. ce
stands 为 所有 碎片 使能 起作用的. bw
x
= l signifies 在 least 一个 字节 写 选择 是 起作用的, bw
x
= 有效的
signifies 那 这 desired 字节 写 选择 是 asserted, 看 写 循环 描述 表格 为 详细信息.
3. 写 是 定义 用 bw
X
, 和 我们. 看 写 循环 描述 表格.
4. 当 一个 写 循环 是 发现, 所有 dqs are 触发-陈述, 甚至 在 字节 写.
5. 这 dq 和 dqp 管脚 是 控制 用 这 电流 循环 和 这 oe
信号. oe是 异步的 和 是 不 抽样 和 这 时钟.
6. CEN
= h, inserts wait states.
7. 设备 将 电源-向上 deselected 和 这 dqs 在 一个 触发-状态 情况, regardless 的 oe
.
8. OE
是 异步的 和 是 不 抽样 和 the 时钟 上升. 它 是 masked 内部 在 写 循环. 在 一个 读 循环 dqs 一个nd dqp
[a:d]
= 触发-状态 当
OE
是 inactive 或者 当 这 设备 是 deselected, 和 dqs 和 dqp
[a:d]
= 数据 当 oe是 起作用的.
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