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资料编号:496184
 
资料名称:MX97102QC
 
文件大小: 309.3K
   
说明
 
介绍:
ISDN S/T CONTROLLER
 
 


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p/n:pm0473
rev. 2.5, sep. 05, 2000
MX97102
管脚 描述 (44-管脚)
表格 1: mx97102 管脚 描述
LQFP PLCC
PAD# PAD# 管脚 名字 i/o 描述
37 41 pad0(d0) 多路复用 总线 模式:地址/数据 总线 从 这 cpu 系统 至 这个 devic
38 42 pad1(d1) ,和 数据 在 这 cpu 系统 和 这个 设备.
39 43 pad2(d2) 非-多路复用 总线 模式:数据 总线 在 这 cpu 系统 和 这个
40 44 pad3(d3) i/o 设备.
41 1 pad4(d4)
42 2 pad5(d5)
43 3 pad6(d6)
44 4 pad7(d7)
27 37 PCSN I chipselect:一个 逻辑 "低" 使能 这个 设备 为 一个 读/写 运作.
28 38 pwrn(r/w)
I
读/写:一个 逻辑 "高" indicates 一个 有效的 读 运作 用 cpu.
一个 逻辑 "低" indicates 一个 有效的 写 运作 用 cpu.(motorola 总线
模式) 写:一个 逻辑 "低" indicates 一个 写 运作.(intel 总线 mode)
29 39 prdn(ds) I 数据 strobe:
这 rising 边缘 marks 这 终止 的 一个 有效的 读 或者 写 运作 (motorola
总线 模式). 读:一个 逻辑 "低" indicates 一个 读 运作.(intel 总线 mode)
8 23 PINTN 打开 中断 要求:这 信号 是 一个 逻辑 "低" 当 这个 设备
requests 一个 流 中断. 它 是 一个 打开 流 输出.
1~5, 14 NC
9,13,15 19,20 非 使用.
17~20 29,30
31~36
45~49
56,60
26 36 PALE I 地址 获得 使能:一个 逻辑 "高" indicates 一个 地址 在 这 地址/
数据 总线(多路复用 总线 类型 仅有的). ale 也 选择 这 微观的-处理器
接口 类型 (多路复用 或者 非-多路复用).
54 9 PRST i/o 重置:一个 逻辑 "高" 在 这个 输入 forces 这个 设备 在 重置 状态. 这
最小 脉冲波 长度 是 四 dcl-时钟 时期 或者 四 ms. 如果 这 终端
明确的 功能 是 使能,这个 设备 将 也 输出 一个 重置 信号.
59 13 PFSC1 o(i) 框架 同步 1:框架 同步 输出. 逻辑 "高" during 频道 0 在 这
gci 接口. 这个 管脚 变为 输入 如果 测试 模式 是 编写程序 (寄存器
adf1).
58 12 PDCL o(i) 数据 clock:时钟 的 频率, 1536khz 输出, 相等 至 两次 这 gci
数据 比率.
这个 管脚 变为 输入 如果 测试 模式 是 编写程序 (寄存器 adf1)
62 16 ECHO O 这个 管脚 输出 这 echo 位 从 这 接到 线条.
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