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资料编号:542480
 
资料名称:PC87332
 
文件大小: 887.12K
   
说明
 
介绍:
PC87332VLJ (3.3V/5V) and PC87332VLJ-5 (5V) (SuperI/OTM III Premium Green) Floppy Disk Controller, Dual UARTs, IEEE1284 Parallel Port, and IDE Interfac
 
 


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10 管脚 描述
(持续)
标识 管脚 IO 函数
PDACK 54 I
Printer DMA Acknowledge
起作用的 输入 acknowledge printer DMA request 使能
RD
WR 输入 一个 DMA transfer 这个 管脚 PDACK 输入 管脚 3 PMC 1
IDENT 3 PMC 0 PDACK
输入 管脚 ECP DMA acknowledge
PDACK
assumed 1 3 PMC 0
IDENT assumed 1 3 PMC 1
这个 输入 有效的 仅有的 ECP mode
PDRQ 33 O
Printer DMA Request
起作用的 输出 信号 DMA 控制 一个 printer 数据 转移
required 这个 管脚 触发-状态 ECP 无能 (位 2 PCR 0) 或者 配置 DMA
(位 3 PMC 0) 这个 输出 有效的 仅有的 ECP mode
PWDN 3I
电源 Down
这个 multi-函数 管脚 stops clocks andor 外部 结晶 为基础
selections 制造 电源 测试 寄存器 1-2 这个 管脚 affects FDC UARTs IDE
并行的 端口 pins 相关的 PMC 寄存器 set (看 ZWS
更远 information)
PE 83 I
Paper End
这个 输入 设置 printer 输出 paper 这个 管脚 一个 名义上的 25 k
X
拉-向下 电阻 连结 it (看 WDATA
表格 7-5 更远 information)
PNF 49 I
Printer Floppy
PNF Printer Floppy 管脚 2 FCR 1 选择 设备
这个 连接 PPM pins 一个 并行的 printer 连接 PNF
e
1 一个 floppy disk
驱动 连接 PNF
e
0 这个 管脚 DRV2 输入 管脚 2 FCR 0 (看 DRV2
更远 information)
RD 19 I
Read
起作用的 输入 信号 数据 microprocessor
RDATA
正常的 35 I
Data
这个 输入 raw 串行 数据 floppy disk drive
模式
RDATA
PPM 91 I
Data
这个 管脚 提供 一个 额外的 数据 信号 PPM 模式 PNF
e
0 (看 PD3
表格 7-5 更远 information)
模式
RI12 70 62 I
环绕 Indicator
这个 indicates 一个 电话 环绕 信号 received MODEM
RI 信号 一个 MODEM 状态 输入 谁的 情况 CPU 测试 6 (ri)
MODEM 状态 寄存器 (msr) 适合的 串行 channel 6 complement RI
signal 2 (teri) MSR indicates whether RI 输入 changed 自从
previous MSR
Note
TERI MSR set 一个 中断 发生 如果 MODEM 状态 中断 enabled
RTS12 74 66 O
要求 Send
low 这个 输出 indicates MODEM 或者 数据 设置 UART 准备好
exchange data RTS
信号 设置 一个 起作用的 程序编制 1 (rts) MODEM
控制 寄存器 一个 level 一个 主控 重置 运作 sets 这个 信号 它的 inactive (高) state
循环 模式 运作 holds 这个 信号 它的 inactive state (看 CFG04 更远 information)
SIN12 75 67 I
串行 Input
这个 输入 receives composite 串行 数据 communications link (eg 附带的
device MODEM 或者 数据 设置)
SLCT 82 I
Select
一个 printer connected sets 这个 输入 high 这个 管脚 一个 名义上的 25 k
X
拉-向下
电阻 连结 it
SLIN 81 IO
选择 Input
这个 信号 选择 printer 这个 管脚 一个 触发-状态 情况 10 ns
aftera0is承载 相应的 控制 寄存器 bit 系统 应当 这个 管脚
使用 一个 47 k
X
resistor (看 ASTRB
步伐 表格 7-5 更远 information)
SOUT12 73 65 O
串行 Output
这个 输出 信号 发送 composite 串行 数据 communications link (eg
附带的 device MODEM 或者 数据 设置) SOUT 信号 设置 一个 标记 状态 (逻辑 1) 之后 一个
主控 重置 operation (看 BOUT CFG04 更远 information)
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