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TIMINGDIAGRAMS
t
w1
CONVST
t
pd1
t
pd2
t
w4
t
su1
BUSY
CS
转变
†
t
CONV
抽样
†
(当 csToggle)
字节
t
w2
t
w3
t
ACQ
t
h1
t
d1
t
en
RD
t
dis
t
h2
t
su2
t
CONV
†
信号 内部的 至 设备
d [7:0]
Hi−Z Hi−Z
db[15:8]
Hi−ZHi−Z
d [15:8]
d [7:0]
db[7:0]
t
d6
t
su4
t
w7
t
d7
t
循环
t
pd1
数据 至
是 读
†
Invalid
previous 转换 电流 转换
Invalid
t
h4
t
su5
(使用 在 正常的
转换)
CONVST
(使用 在 abort)
t
su(ab)
t
su(ab)
ADS8406
SLAS426A–AUGUST2004–REVISEDDECEMBER2004
figure1.timingforconversionandacquisitioncycleswithcsandrdtoggling
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