PLL1705
PLL1706
SLES046A
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8月 2002
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修订 九月 2002
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12
程序-寄存器 位 mapping
这 建造-在 功能 的 这 pll1706 是 控制 通过 一个 16-位 程序 寄存器. 这个 寄存器 是 承载 使用 md,
mc 和 ml. 之后 这 16 数据 位 是 clocked 在 使用 这 rising 边缘 的 mc, ml 是 使用 至 获得 这 数据 在 这 寄存器.
表格 6 显示 这 位 mapping 的 这 寄存器. 这 串行 模式 控制 format 和 控制 数据 输入 定时 是 显示 在
图示 12 和 图示 13, 各自.
ML
MC
MD D15 D14 D13 D12 D11 D10 D9 D8 D7 D6 D5 D4 D3 D2 D1 D0
图示 12. 串行 模式 控制 format
t
(mll)
V
DD
/2
MC
MD
MSB
ML
t
(mhh)
V
DD
/2
V
DD
/2
t
(mls)
t
(mlh)
t
(mcl)
t
(mch)
LSB
t
(mdh)
t
(mcy)
t
(mds)
t
(mls)
描述 标识
最小值 典型值 最大值 单位
mc 脉冲波 循环 时间 t
MCY
100 ns
mc 脉冲波 持续时间 低 t
MCL
40 ns
mc 脉冲波 持续时间 高 t
MCH
40 ns
md 支撑 时间 t
MDH
40 ns
md 建制 时间
t
MDS
40 ns
ml 低-水平的 时间 t
MLL
16 mc clocks
(1)
ml 高-水平的 时间
t
MHH
200 ns
ml 支撑 时间
(2)
t
MLH
40 ns
ml 建制 时间
(3)
t
MLS
40 ns
(1)
mc clocks: mc 时钟 时期
(2)
mc rising 边缘 为 lsb 至 ml rising 边缘
(3)
ml rising 边缘 至 这 next mc rising 边缘. 如果 这 mc 时钟 是 stopped 之后 这 lsb, 任何 ml 上升 时间 是 accepted.
图示 13. 控制 数据 输入 定时
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