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资料编号:568010
 
资料名称:QS5919T160J
 
文件大小: 129.78K
   
说明
 
介绍:
LOW SKEW TTL PLL CLOCK DRIVER WITH INTEGRATED LOOP FILTER
 
 


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本平台电子爱好着纯手工中文简译:截至2020/5/17日,支持英文词汇500个
5
工业的 温度 范围
QS5919T
低 skew ttl pll 时钟 驱动器 和 整体的 循环 过滤

标识 描述
(1)
最小值 最大值 单位
t
R
, t
F
最大 输入 上升 和 下降 时间, 0.8v 至 2v 3 ns
F
I
输入 时钟 频率, 同步
0
, 同步
1
(1)
2.5 F
最大值 _2xq
MHz
t
PWC
输入 时钟 脉冲波, 高 或者 低
(2)
2—ns
D
H
输入 职责 循环
(2)
25 75 %
注释:
1. 看 输出 频率 和 频率 选择 tables 为 更多 detail 在 容许的 同步 输入 发生率 为 不同的 速grades 和
不同的 反馈 和 freq_sel 结合体.
2. 在哪里 脉冲波 witdh 暗指 用 d
H
是 较少 比 t
WPC
限制, t
WPC
限制 应用

标识 参数
(1)
最小值 最大值 单位
t
SKR
输出 skew 在 rising edges, q
0
-q
4
和 q/
2
(2)
350 ps
t
SKF
输出 skew 在 下落 edges, q
0
-q
4
和 q/
2
(2)
350 ps
t
SKALL
输出 skew, 所有 输出
(2,5)
500 ps
t
PW
脉冲波 宽度, 2xq 输出, >40mhz
T
CY
/2
0.4
T
CY
/2 + 0.4 ns
t
PW
脉冲波 宽度, q
0
-q
4
, q
5,
q/
2
输出, 80mhz
T
CY
/2
0.4
T
CY
/2 + 0.4 ns
t
J
循环-至-循环 jitter
(4)
0.15
0.15 ns
t
PD
同步 输入 至 反馈 延迟
(6)
500
0ps
t
同步 至 阶段 锁 10 ms
t
PZH
t
PZL
输出 使能 时间, oe/
RST
低 至 高
(3)
07ns
t
PHZ
t
PLZ
输出 使能 时间, oe/
RST
高 至 低
(3)
06ns
t
r,
t
F
输出 上升/下降 时间, 0.8v
2V
0.3 1.5 ns
注释:
1. 看 测试 负载 和 波形 为 测试 加载 和 末端. 测试 电路 1 是 使用 为 输出 使能/使不能运转 参数. 测试 电路 2 是 使用 为 所有
其它 定时 参数.
2. skew 规格 应用 下面 完全同样的 环境 (加载, 温度, v
CC
, 设备 速 等级).
3. 量过的 在 打开 循环 模式 pll_en = 0.
4. jitter 是 典型 和 q 输出 在 20mhz. 看 频率 选择 表格 为 信息 在 恰当的 freq_sel 水平的 为 specified 输入
发生率.
5. skew 量过的 在 选择 同步 边缘.
6. t
PD
量过的 在 设备 输入 在 1.5v, q 输出 在 80mhz.
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