ADS7846
14
SBAS125H
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16 clocks-每-转换
这 控制 位 为 转换 n + 1 能 是 overlapped 和
转换 n 至 准许 为 一个 转换 每 16 时钟 循环,
作 显示 在 图示 10. 这个 图示 也 显示 可能 串行
交流 occurring 和 其它 串行 peripherals 是-
tween 各自 字节 转移 从 这 处理器 至 这 转换器.
这个 是 可能 提供 那 各自 转换 完成
在里面 1.6ms 的 开始. 否则, 这 信号 那 是 cap-
tured 在 这 输入 样本-和-支撑 将 droop 足够的 至
影响 这 转换 结果. 便条 那 这 ads7846 是 全部地
powered 当 其它 串行 communications 是 带去 放置
在 一个 转换.
数字的 定时
计算数量 9, 11, 和 表格 vi 提供 详细地 定时 为 这
数字的 接口 的 这 ads7846.
标识 描述 最小值 典型值 最大值 单位
t
ACQ
acquisition 时间 1.5
µ
s
t
DS
din 有效的 较早的 至 dclk rising 100 ns
t
DH
din 支撑 之后 dclk 高 10 ns
t
做
dclk 下落 至 dout 有效的 200 ns
t
DV
CS
下落 至 dout 使能 200 ns
t
TR
CS
rising 至 dout 无能 200 ns
t
CSS
CS
下落 至 第一 dclk rising 100 ns
t
CSH
CS
rising 至 dclk ignored 0 ns
t
CH
dclk 高 200 ns
t
CL
dclk 低 200 ns
t
BD
dclk 下落 至 busy rising 200 ns
t
BDV
CS
下落 至 busy 使能 200 ns
t
BTR
CS
rising 至 busy 无能 200 ns
表格 vi. 定时 规格 (+v
CC
= +2.7v 和 在之上,
T
一个
=
–
40
°
c 至 +85
°
c, c
加载
= 50pf).
PD0
t
BDV
t
DH
t
CH
t
CL
t
DS
t
CSS
t
DV
t
BD
t
BD
t
TR
t
BTR
t
D0
t
CSH
DCLK
CS
11
DOUT
BUSY
DIN
10
图示 11. 详细地 定时 图解.
图示 10. 转换 定时, 16 clocks-每-转换, 8-位 总线 interface. 非 dclk 延迟 必需的 和 专心致志的
串行 端口.
1
DCLK
CS
81
11
DOUT
BUSY
S
DIN
控制 位
S
控制 位
1098765 43210
11 10 9
81 18
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