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W78E354
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*
CONTREG1
: 控制 register1, 位-addressable.
位 名字 函数 便条
0 ADCS0 模数转换器 频道 选择 位 0 看 部分 e.10.
1 ADCS1 模数转换器 频道 选择 位 1 看 部分 e.10.
2 ENDDC1 使能 ddc1 看 在下.
3 HCES h-clamp 边缘 选择 看 部分 e.12.f.
4 HCWS0 h-clamp 宽度 选择 位 0 看 部分 e.12.f.
5 HCWS1 h-clamp 宽度 选择 位 1 看 部分 e.12.f.
6 DUMMYEN dummy 信号 使能 看 部分 e.12. '同步 处理器
块 图解' &放大; e.12.e.
7 ADCSTRT 开始 模数转换器 转换
0: 停止, 1: 开始
看 部分 e.10.
DDC1
ENDDC1
ddc 端口
p1.2/dscl
p1.3/dsda
i  c
2
支持 ddc2b/2b+
支持 ddc1
在
在
输出
输出
输出
SCL
SDA
SDA
SCL
0
1
从 vsync

标　题:
内　容:
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W78E354 -16- * CONTREG1 : 控制 register1, 位-addressable. 位名字函数便条 0 ADCS0 模数转换器频道选择位 0 看部分 e.10. 1 ADCS1 模数转换器频道选择位 1 看部分 e.10. 2 ENDDC1 使能 ddc1 看在下. 3 HCES h-clamp 边缘选择看部分 e.12.f. 4 HCWS0 h-clamp 宽度选择位 0 看部分 e.12.f. 5 HCWS1 h-clamp 宽度选择位 1 看部分 e.12.f. 6 DUMMYEN dummy 信号使能看部分 e.12. '同步处理器块图解' &放大; e.12.e. 7 ADCSTRT 开始模数转换器转换 0: 停止, 1: 开始看部分 e.10. DDC1 ENDDC1 ddc 端口 p1.2/dscl p1.3/dsda i c 2 支持 ddc2b/2b+ 支持 ddc1 在在输出输出输出 SCL SDA SDA SCL 0 1 从 vsync

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