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w83195r-08
初步的
发行 释放 日期: 三月. 1999
-2-  修订 0.30
3.0  块 图解
PLL2
XTAL
OSC
展开
Spectrum
PLL1
获得
POR
停止
1/2
控制
逻辑
config.
reg.
停止
停止
停止
PCI
时钟
分隔物
~
~
6
4
2
17
5
48MHz
24MHz
IOAPIC
ref(0:1)
cpuclk_f
CPUCLK1
sdram(0:15)
pciclk(0:4)
pciclk_f
Xin
Xout
缓存区 在
fs(0:3)*
4
MODE*
cpu_stop#
pci_stop#
SDATA*
SDCLK*
sdram_f
4.0  管脚 配置
48
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Vddq1
* pci_stop#/ref0
Vss
Xin
Xout
Vddq2
pciclk_f/mode*
pciclk0/fs3*
Vss
PCICLK1
PCICLK2
PCICLK3
PCICLK4
Vddq2
缓存区 在
SDRAM11
SDRAM10
Vddq3
sdram 9
sdram 8
Vss
SDATA
SDCLK
VddL1
IOAPIC0
ioapic_f
Vss
cpuclk_f
CPUCLK1
VddL2
cpu_stop#
SDRAM12
Vss
sdram 0
sdram 1
sdram 2
Vddq3
sdram 3
Vss
sdram 4
sdram 5
sdram 6
sdram 7
Vddq4
Vddq3
48mhz/fs0*
24mhz/fs1*
PCICLK5
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sdram 15
sdram 14
Vss
ref1/ fs2*
sdram 12
sdram 13
Vss
sdram_f

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w83195r-08 初步的发行释放日期: 三月. 1999 -2- 修订 0.30 3.0 块图解 PLL2 XTAL OSC 展开 Spectrum PLL1 获得 POR 停止 1/2 控制逻辑 config. reg. 停止停止停止 PCI 时钟分隔物 ~ ~ 6 4 2 17 5 48MHz 24MHz IOAPIC ref(0:1) cpuclk_f CPUCLK1 sdram(0:15) pciclk(0:4) pciclk_f Xin Xout 缓存区在 fs(0:3)* 4 MODE* cpu_stop# pci_stop# SDATA* SDCLK* sdram_f 4.0 管脚配置 48 47 46 45 44 43 42 41 40 39 38 37 36 35 34 33 32 31 30 1 2 3 4 5 6 7 8 9 10 11 12 13 14 15 16 17 18 19 20 21 22 23 24 Vddq1 * pci_stop#/ref0 Vss Xin Xout Vddq2 pciclk_f/mode* pciclk0/fs3* Vss PCICLK1 PCICLK2 PCICLK3 PCICLK4 Vddq2 缓存区在 SDRAM11 SDRAM10 Vddq3 sdram 9 sdram 8 Vss SDATA SDCLK VddL1 IOAPIC0 ioapic_f Vss cpuclk_f CPUCLK1 VddL2 cpu_stop# SDRAM12 Vss sdram 0 sdram 1 sdram 2 Vddq3 sdram 3 Vss sdram 4 sdram 5 sdram 6 sdram 7 Vddq4 Vddq3 48mhz/fs0* 24mhz/fs1* PCICLK5 29 26 27 28 25 55 54 53 52 51 50 49 56 sdram 15 sdram 14 Vss ref1/ fs2* sdram 12 sdram 13 Vss sdram_f

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