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资料编号:711228
 
资料名称:WM8521HCGED
 
文件大小: 304.86K
   
说明
 
介绍:
STEREO DAC WITH INTEGRATED OUTPUT STAGE FOR 2VRMS LINE OUT
 
 


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本平台电子爱好着纯手工中文简译:截至2020/5/17日,支持英文词汇500个
WM8521
产品 预告(展)
w
pp rev 1.3 12月 2004
12
正确的 频道left 频道
LRCLK
BCLK
DIN
1/fs
MSB
12 15 16
LSB
12 15 16
MSB
1
最大值 4 bclks
非 有效的 数据
输入 文字 长度 (16 位)
图示 5 dsp ‘late’ 模式 定时
正确的 频道left 频道
LRCLK
BCLK
DIN
1/fs
MSB
12 15 16
LSB
12 15 16
最大值 4 bclks
非 有效的 数据
输入 文字 长度 (16 位)
1 bclk 1 bclk
图示 6 dsp ‘early’ 模式 定时
音频的 数据 抽样 比率
这 主控 时钟 为 wm8521 支持 音频的 抽样 比率 从 256fs 至 768fs, 在哪里 fs 是 这
音频的 抽样 频率 (lrclk) 典型地 32khz, 44.1khz, 48khz 或者 96khz. 这 主控 时钟 是
使用 至 运作 这 数字的 过滤 和 这 噪音 shaping 电路.
这 wm8521 有 一个 主控 时钟 发现 电路 那 automatically 确定 这 relationship
在 这 主控 时钟 频率 和 这 抽样 比率 (至 在里面 +/- 32 主控 clocks). 如果 那里 是
一个 更好 比 32 clocks 错误, 这 主控 时钟 defaults 至 768fs. 这 主控 时钟 应当 是
synchronised 和 lrclk, 虽然 这 wm8521 是 tolerant 的 阶段 differences 或者 jitter 在 这个
时钟.
主控 时钟 频率 (mhz) (mclk)
抽样
比率
(lrclk)
256fs 384fs 512fs 768fs
32kHz 8.192 12.288 16.384 24.576
44.1khz 11.2896 16.9344 22.5792 33.8688
48kHz 12.288 18.432 24.576 36.864
96khz 24.576 36.864 无法得到 无法得到
表格 1 主控 时钟 发生率 相比 抽样 比率
便条:
为 样本 比率 向下 至 8k, 规模 mclk accordingly.
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