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资料编号:711340
 
资料名称:WM8782SEDS
 
文件大小: 216.85K
   
说明
 
介绍:
24-Bit, 192kHz Stereo ADC
 
 


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WM8782
产品 预告(展)
w
pp, 将 2004, rev 1.0
12
音频的 数据 formats
Left Justified 模式, MSB 第一 rising 边缘 BCLK 下列的 一个 LRCLK
转变. 其它 向上 LSB 然后 transmitted 顺序. 取决于 文字 长度,
bclk 频率 和 样本 比率, 那里 将 是 unused bclk 循环 在之前 各自 lrclk 转变.
图示 7 left justified 音频的 接口 (假设 n-位 文字 长度)
正确的 Justified 模式, LSB last rising 边缘 BCLK 在之前 一个 LRCLK
转变. 所有 其它 transmitted 在之前 (msb 第一). 取决于 文字 长度, BCLK
频率 和 样本 比率, 那里 将 是 unused bclk 循环 之后 各自 lrclk 转变.
图示 8 正确的 justified 音频的 接口 (假设 n-位 文字 长度)
在 i
2
s 模式, 这 msb 是 有 在 这 第二 rising 边缘 的 bclk 下列的 一个 lrclk 转变.
其它 向上 LSB 然后 transmitted 顺序. 取决于 文字 长度, BCLK
频率 和 样本比率,那里将 是 unused bclk循环 在 这 lsb 的 一个 样本 和
这 msb 的 这 next.
图示 9 - i
2
s justified 音频的 接口 (假设 n-位 文字 长度)
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