40mx 和 42mx fpga families
v6.0 1-13
开发 tool 支持
这 mx 家族 的 fpgas 是 fully supported 用 两个都 actel's
libero™ 整体的 设计环境和 设计者
fpga 开发 软件. actel libero ide 是 一个 设计
管理 环境 th在 streamlines 这 设计
流动. libero ide 提供 一个 整体的 设计 manager
那 seamlessly integrates 设计 tools 当 guiding 这
用户 通过 这 设计 流动, managing 所有 设计 和
log files, 和 passing 需要 设计 数据 among tools.
additionally, libero ide 准许 用户 至 合并 两个都
图式 和 hdl 综合 在 一个 单独的 流动 和 核实
这 全部 设计 在 一个 单独的 环境. libero ide
包含 synplify® 为 actel 从 synplicity®, viewdraw
为 actel 从 mentor graphics, modelsim™ hdl
simulator 从 mentor graphics®, waveformer lite™
从 synapticad™, 和 设计者 软件 从 actel.
谈及 至 这
libero ide流动
(located 在 actel’s 网站)
图解 为 更多 信息.
actel's 设计者 软件 是一个 放置-和-route tool 和
提供 一个 comprehensive 合适e 的 backend 支持 tools
为 fpga 开发. 这 设计者 软件 包含
定时-驱动 放置-和-route, 和 一个 world-类
整体的 静态的 定时 一个alyzer 和 constraints editor.
和 这 设计者 软件, 一个 用户 能 锁 his/her
设计 管脚 在之前 布局 当 minimally impacting 这
结果 的 放置-和-route. additionally, 这 后面的-
annotation 流动 是 compatible 和 所有 这 主要的
simulators 和 这 simulation 结果 能 是 交叉-probed
和 硅 explorer ii, actel’s 整体的 verification
和 逻辑 分析 tool. another tool 包含 在 这
设计者 软件 是 这 actgen macro builder, 这个
容易地 creates popular 和 commonly 使用 逻辑
功能 为 implementation 在 your 图式 或者 hdl
设计. actel's 设计者 软件 是 兼容 和 这
大多数 popular fpga 设计 entry 和 verification tools
从 公司 此类 作 mentor graphics, synplicity,
synopsys, 和 cadence 设计 系统. 这 设计者
软件 是 有 为 两个都 这 windows 和 unix
运行 系统.
actel's 设计者 软件 是 兼容 和 这 大多数
popular fpga 设计 entry 和 verification tools 从
公司 此类 作 mentor graphics, synplicity, synopsys,
和 cadence 设计 系统. 这 设计者 软件 是
有 为 两个都 这 windows 和 unix 运行
系统.
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应用 注释
actel bsdl files format 描述
www.actel.com/documents/bsdlformat_一个.pdf
程序编制 antifuse 设备
http://www.actel.com/documents/
antifuseprogram_一个.pdf
actel's implementation 的 安全 在 actel antifuse
FPGAs
www.actel.com/documents/antifuse_安全_一个.pdf
用户’s guides 和 manuals
antifuse macro 库 手册
www.actel.com/documents/libguide_ug.pdf
硅 sculptor ii
www.actel.com/techdocs/manuals/default.asp#programmers
Miscellaneous
libero ide 流动 图解
www.actel.com/产品/tools/libero/流动.html
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