A54SX16P-2PQ208I_集成电路资料查询网

v3.1 23
54sx 家族 fpgas
输出 缓存区 延迟
交流 测试 负载
输入 缓存区 延迟 c-cell 延迟
至 交流 测试 负载 (显示 在下)
PAD
D
E
TRIBUFF
在
V
CC
地
50%
输出
V
OL
V
OH
1.5v
t
DLH
50%
1.5v
t
DHL
En
V
CC
地
50%
输出
V
OL
1.5v
t
ENZL
50%
10%
t
ENLZ
En
V
CC
地
50%
输出
地
V
OH
1.5v
t
ENZH
50%
90%
t
ENHZ
V
CC
加载 1
(使用 至 measure
加载 2
(使用 至 measure 使能 延迟)
35 pf
至 这 输出
V
CC
地
35 pf
至 这 输出
r 至 v
CC
为 t
PZL
r 至 地 为 t
PZH
r = 1 k
Ω
传播 延迟)
下面 测试
下面 测试
加载 3
(使用 至 measure 使不能运转 延迟)
V
CC
地
5 pf
至 这 输出
r 至 v
CC
为 t
PLZ
r 至 地 为 t
PHZ
r = 1 k
Ω
下面 测试
PAD
Y
INBUF
在
3V
0V
1.5v
输出
地
V
CC
50%
t
INY
1.5v
50%
t
INY
S
一个
B
Y
s, 一个 或者 b
输出
地
V
CC
50%
t
PD
输出
地
地
V
CC
50%
50%
50%
V
CC
50% 50%
t
PD
t
PD
t
PD

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v3.1 23 54sx 家族 fpgas 输出缓存区延迟交流测试负载输入缓存区延迟 c-cell 延迟至交流测试负载 (显示在下) PAD D E TRIBUFF 在 V CC 地 50% 输出 V OL V OH 1.5v t DLH 50% 1.5v t DHL En V CC 地 50% 输出 V OL 1.5v t ENZL 50% 10% t ENLZ En V CC 地 50% 输出地 V OH 1.5v t ENZH 50% 90% t ENHZ V CC 加载 1 (使用至 measure 加载 2 (使用至 measure 使能延迟) 35 pf 至这输出 V CC 地 35 pf 至这输出 r 至 v CC 为 t PZL r 至地为 t PZH r = 1 k Ω 传播延迟) 下面测试下面测试加载 3 (使用至 measure 使不能运转延迟) V CC 地 5 pf 至这输出 r 至 v CC 为 t PLZ r 至地为 t PHZ r = 1 k Ω 下面测试 PAD Y INBUF 在 3V 0V 1.5v 输出地 V CC 50% t INY 1.5v 50% t INY S 一个 B Y s, 一个或者 b 输出地 V CC 50% t PD 输出地地 V CC 50% 50% 50% V CC 50% 50% t PD t PD t PD

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