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资料编号:746729
 
资料名称:ADS8343EB
 
文件大小: 446K
   
说明
 
介绍:
16-Bit, 4-Channel Serial Output Sampling ANALOG-TO-DIGITAL CONVERTER
 
 


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本平台电子爱好着纯手工中文简译:截至2020/5/17日,支持英文词汇500个
ADS8343
16
SBAS183A
www.德州仪器.com
噪音
这 噪音 floor 的 这 ads8343 它自己 是 极其 低, 作 能
是 seen 从 计算数量 12 和 13, 和 是 更 更小的 比
competing 一个/d 转换器. 这 ads8343 是 测试 在 两个都
5v 和 2.7v 和 在 两个都 这 内部的 和 外部 时钟
模式. 一个 低-水平的 直流 输入 是 应用 至 这 相似物 输入
管脚 和 这 转换器 是 放 通过 5000 conversions.
这 数字的 输出 的 这 一个/d 转换器 将 相异 在 输出 代号
预定的 至 这 内部的 噪音 的 这 ads8343. 这个 是 真实 为 所有
16-位, sar-类型, 一个/d 转换器. 使用 一个 histogram 至 plot
这 输出 代号, 这 分发 应当 呈现 bell-shaped
和 这 顶峰 的 这 bell 曲线 representing 这 名义上的 代号
为 这 输入 值. 这
±
1
σ
,
±
2
σ
, 和
±
3
σ
distributions 将
代表 这 68.3%, 95.5%, 和 99.7%, 各自, 的 所有
代号. 这 转变 噪音 能 是 计算 用 dividing 这
号码 的 代号 量过的 用 6 和 这个 将 yield 这
±
3
σ
分发 或者 99.7% 的 所有 代号. statistically, 向上 至 3 代号
可以 下降 外部 这 分发 当 executing 1000 con-
版本. 这 ads8343, 和 < 3 输出 代号 为 这
±
3
σ
分发, 将 yield 一个 <
±
0.5lsb 转变 噪音 在 5v
运作. remember, 至 达到 这个 低 噪音 perfor-
mance, 这 顶峰-至-顶峰 噪音 的 这 输入 信号 和
涉及 必须 是 < 50
µ
v.
图示 12. histogram 的 5000 conversions 的 一个 直流 输入 在 这
代号 转变, 5v 运作 外部 时钟 模式.
图示 13. histogram 的 5000 conversions 的 一个 直流 输入 在 这
代号 中心, 2.7v 运作 内部的 时钟 模式.
3295
774
95
131
705
FFFE
H
FFFF
H
0000
H
0001
H
0002
H
代号
2387
694
905
512
411
38 38
87
FFFE
H
FFFD
H
FFFC
H
FFFF
H
0000
H
0001
H
0002
H
0003
H
0004
H
代号
AVERAGING
这 噪音 的 这 一个/d 转换器 能 是 补偿 用
averaging 这 数字的 代号. 用 averaging 转换 结果,
转变 噪音 将 是 减少 用 一个 因素 的 1/
n
, 在哪里 n
是 这 号码 的 averages. 为 例子, averaging 4 变换器-
sion 结果 将 减少 这 转变 噪音 用 1/2 至
±
0.25lsbs. averaging 应当 仅有的 是 使用 为 输入 信号
和 发生率 near 直流.
为 交流 信号, 一个 数字的 过滤 能 是 使用 至 低-通过 过滤
和 decimate 这 输出 代号. 这个 工作 在 一个 类似的
manner 至 averaging; 为 每 decimation 用 2, 这 信号-
至-噪音 比率 将 改进 3db.
布局
为 最佳的 效能, 小心 应当 是 带去 和 这
物理的 布局 的 这 ads8343 电路系统. 这个 是 特别 真实
如果 这 涉及 电压 是 低 和/或者 这 转换 比率 是 高.
这 基本 sar architecture 是 敏感的 至 glitches 或者 sudden
改变 在 这 电源 供应, 涉及, 地面 连接,
和 数字的 输入 那 出现 just 较早的 至 闭锁 这 输出 的 这
相似物 比较器. 因此, 在 任何 单独的 转换 为 一个 n-
位 sar 转换器, 那里 是 n
windows
在 这个 大 外部
瞬时 电压 能 容易地 影响 这 转换 结果. 此类
glitches might originate 从 切换 电源 供应, nearby
数字的 逻辑, 和 高-电源 设备. 这 程度 的 错误 在 这
数字的 输出 取决于 在 这 涉及 电压, 布局, 和 这
精确的 定时 的 这 外部 事件. 这 错误 能 改变 如果 这
外部 事件 改变 在 时间 和 遵守 至 这 dclk 输入.
和 这个 在 mind, 电源 至 这 ads8343 应当 是 clean 和
好 绕过. 一个 0.1
µ
f 陶瓷的 绕过 电容 应当 是
放置 作 关闭 至 这 设备 作 可能. 在 增加, 一个 1
µ
F
至 10
µ
f 电容 和 一个 5
或者 10
序列 电阻 将 是
使用 至 低-通过 过滤 一个 嘈杂的 供应.
这 涉及 应当 是 similarly 绕过 和 一个 1
µ
F
电容. 又一次, 一个 序列 电阻 和 大 电容 能 是
使用 至 低-通过 过滤 这 涉及 电压. 如果 这 涉及
电压 originates 从 一个 运算 放大, 制造 确信 那 它 能
驱动 这 绕过 电容 没有 振动 (这 序列
电阻 能 帮助 在 这个 情况). 这 ads8343 牵引 非常 little
电流 从 这 涉及 在 平均, 但是 它 做 放置
大 要求 在 这 涉及 电路系统 在 短的 时期
的 时间 (在 各自 rising 边缘 的 dclk 在 一个 转换).
这 ads8343 architecture 提供 非 固有的 拒绝 的
噪音 或者 电压 变化 在 regards 至 这 涉及 输入.
这个 是 的 particular concern 当 这 涉及 输入 是 系
至 这 电源 供应. 任何 噪音 和 波纹 从 这 供应 将
呈现 直接地 在 这 数字的 结果. 当 高-频率
噪音 能 是 filtered 输出 作 discussed 在 这 previous
paragraph, 电压 变化 预定的 至 线条 频率 (50hz 或者
60hz) 能 是 difficult 至 除去.
这 地 管脚 应当 是 连接 至 一个 clean 地面 要点. 在
许多 具体情况, 这个 将 是 这
相似物
地面. 避免 connec-
tions 这个 是 too near 这 grounding 要点 的 一个 微控制器
或者 数字的 信号 处理器. 如果 需要, run 一个 地面 查出
直接地 从 这 转换器 至 这 电源-供应 entry 要点. 这
完美的 布局 将 包含 一个 相似物 地面 平面 专心致志的 至
这 转换器 和 有关联的 相似物 电路系统.
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