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初步的
1996 微芯 技术 公司
portd 能 是 一个 bi-directional i/o 端口 或者 并行的
从动装置 端口 为 接合 至 一个 微处理器 总线.
rd0/psp0 19 38 21 i/o st/ttl
(3)
rd1/psp1 20 39 22 i/o st/ttl
(3)
rd2/psp2 21 40 23 i/o st/ttl
(3)
rd3/psp3 22 41 24 i/o st/ttl
(3)
rd4/psp4 27 2 30 i/o st/ttl
(3)
rd5/psp5 28 3 31 i/o st/ttl
(3)
rd6/psp6 29 4 32 i/o st/ttl
(3)
rd7/psp7 30 5 33 i/o st/ttl
(3)
porte 是 一个 bi-directional i/o 端口.
re0/rd
8 25 9 i/o st/ttl
(3)
re0/rd
读 控制 为 并行的 从动装置 端口.
re1/wr
9 26 10 i/o st/ttl
(3)
re1/wr 写 控制 为 并行的 从动装置 端口.
re2/cs
10 27 11 i/o st/ttl
(3)
re2/cs
选择 控制 为 并行的 从动装置 端口.
V
SS
12,31 6,29 13,34 P — 地面 涉及 为 逻辑 和 i/o 管脚.
V
DD
11,32 7,28 12,35 P — 积极的 供应 为 逻辑 和 i/o 管脚.
NC — 12,13,
33,34
1,17
28,40
— — 不 连接.
名字
插件
管脚 #
QFP
管脚 #
PLCC
管脚 #
i/o/p
类型
缓存区
类型
描述
legend: o = 输出 i/o = 输入/输出 p = 电源
i = 输入 — = 不 使用 st = 施密特 触发 输入
ttl = ttl 输入
便条 1: 这个 缓存区 是 一个 施密特 触发 输入 当 configured 作 这 外部 中断.
2: 这个 缓存区 是 一个 施密特 触发 输入 当 使用 在 串行 程序编制 模式.
3: 这个 缓存区 是 一个 施密特 触发 输入 当 configured 作 一个 一般 目的 i/o 和 一个 ttl 输入 当 使用
在 这 并行的 从动装置 端口 模式 (为 接合 至 一个 微处理器 端口).
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