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资料编号:751659
 
资料名称:CD74HC4046AE
 
文件大小: 316K
   
说明
 
介绍:
High-Speed CMOS Logic Phase-Locked Loop with VCO
 
 


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应用 信息
这个 信息 一个 手册 approximation
外部 组件 使用 ’HC4046A
’hct4046a 在 一个 阶段-锁-循环 系统.
References 应当 制造 计算数量 11 通过 15
计算数量 27 通过 32 作 表明 在 这 表格.
选择 组件 应当 在里面
下列的 范围:
hc/hct4046a c
PD
碎片 部分 HC HCT 单位
比较器 1 48 50 pF
comparators 2 和 3 39 48 pF
VCO 61 53 pF
R1 在 3k
和 300k
R2 在 3k
和 300k
r1 + r2 并行的 值 > 2.7k
C1 更好 比 40pf
主题
阶段
比较器 设计 仔细考虑
vco 频率
没有 extra 补偿
pc1, pc2 或者 pc3 vco 频率 典型的
和 r2 =
和 r1 在里面 这 范围 3k
< r1 < 300k
, 这 特性 的 这 vco
运作 将 是 作 显示 在 计算数量 11 - 15. (预定的 至 r1, c1 时间 常量 一个 小 补偿
仍然是 当 r2 =
.)
PC1 选择 的 r1 和 c1
给 f
o
, 决定 这 值 的 r1 和 c1 使用 计算数量 11 - 15
pc2 或者 pc3 f
最大值
计算 f
o
f
最大值
/2 决定 R1 C1 使用 计算数量 11 -
15. 获得 2f
L
:2f
L
1.2 (v
CC
- 1.8v)/(r1c1) 在哪里 有效的 范围 VCO
1.1v < VCO
< v
CC
- 0.9v
VCO 频率
extra 补偿
pc1, pc2 或者 pc3 vco 频率 典型的
R1 R2 在里面 范围 3k
< R1 < 300k
,3k
, < R2 < 300k
, 特性
的 这 vco 运作 将 是 作 显示 在 计算数量 27 - 32.
pc1, pc2 或者 pc3 选择 的 r1, r2 和 c1
给 f
o
和 f
L
, 补偿 频率, f
最小值
, 将 是 计算 从 f
最小值
f
o
- 1.6 f
L
.
获得 这 值 的 c1 和 r2 用 使用 计算数量 27 - 30.
计算 这 值 的 r1 从 计算数量 31 - 32.
图示 44. 频率 典型的 的 vco 运行 没有
补偿: f
o
= 中心 频率: 2f
L
= 频率 锁 范围
f
最大值
f
VCO
f
o
f
最小值
最小值
1/2 v
CC
V
VCOIN
最大值
2f
L
图示 45. 频率 典型的 的 vco 运行 和 补偿:
f
o
= 中心 频率: 2f
L
= 频率 锁 范围
f
最大值
f
VCO
f
o
f
最小值
最小值
1/2 v
CC
V
VCOIN
最大值
2f
L
cd54hc4046a, cd74hc4046a, cd54hct4046a, cd74hct4046a
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