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资料编号:751659
 
资料名称:CD74HC4046AE
 
文件大小: 316K
   
说明
 
介绍:
High-Speed CMOS Logic Phase-Locked Loop with VCO
 
 


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20
pll 情况 和
非 信号 在 这
SIG
输入
PC1 vco adjusts 至 f
o
φ
DEMOUT
= 90
o
和 v
VCOIN
= 1/2 v
CC
(看 图示 2)
PC2 vco adjusts 至 f
最小值
φ
DEMOUT
= -360
o
和 v
VCOIN
= 0v (看 图示 4)
PC3 vco adjusts 至 f
最大值
φ
DEMOUT
= 360
o
和 v
VCOIN
= v
CC
(看 图示 6)
pll 频率
俘获 范围
pc1, pc2 或者 pc3 循环 过滤 组件 选择
pll locks 在
和声学 在 中心
频率
pc1 或者 pc3 Yes
PC2
噪音 拒绝 在
信号 输入
PC1
pc2 或者 pc3
交流 波纹 内容
当 pll 是 锁
PC1 f
r
= 2f
i
, 大 波纹 内容 在
φ
DEMOUT
= 90
o
PC2 f
r
= f
i
, 小 波纹 内容 在
φ
DEMOUT
= 0
o
PC3 f
r
= fsig
, 大 波纹 内容 在
φ
DEMOUT
= 180
o
主题
阶段
比较器 设计 仔细考虑
一个 小 俘获 范围 (2f
c
) 是 得到 如果
τ
> 2f
c
1/
π
(2
π
f
L
/
τ
.)
1/2
图示 46. 简单的 循环 过滤 为 pll 没有 补偿
(一个)
τ
= r3 x c2
(b) 振幅 典型的 (c) 柱子-零 图解
R3
C2
输入 输出
|F
(j
ω
)
|
ω
-1/
τ
图示 47. 简单的 循环 过滤 为 pll 和 补偿
(一个)
τ
1 = r3 x c2;
(b) 振幅 典型的 (c) 柱子-零 图解
|F
(j
ω
)
|
ω
-1/
τ
2
R3
C2
输入 输出
τ
2 = r4 x c2;
τ
3 = (r3 + r4) x c2
-1/
τ
3
m
1/
τ
3
1/
τ
2
R4
m =
R4
r3 + r4
cd54hc4046a, cd74hc4046a, cd54hct4046a, cd74hct4046a
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